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参数资料
| 型号： | MC9S08QD2CPC |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PDIP8 |
| 封装： | ROHS COMPLIANT, PLASTIC, DIP-8 |
| 文件页数： | 164/198页 |
| 文件大小： | 2473K |
| 代理商： | MC9S08QD2CPC |
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Chapter 6 Parallel Input/Output Control
MC9S08QD4 Series MCU Data Sheet, Rev. 6
68
Freescale Semiconductor
Figure 6-1. Parallel I/O Block Diagram
The data direction control bit (PTxDDn) determines whether the output buffer for the associated pin is
enabled, and also controls the source for port data register reads. The input buffer for the associated pin is
always enabled unless the pin is enabled as an analog function or is an output-only pin.
When a shared digital function is enabled for a pin, the output buffer is controlled by the shared function.
However, the data direction register bit will continue to control the source for reads of the port data register.
When a shared analog function is enabled for a pin, both the input and output buffers are disabled. A value
of 0 is read for any port data bit where the bit is an input (PTxDDn = 0) and the input buffer is disabled. In
general, whenever a pin is shared with both an alternate digital function and an analog function, the analog
function has priority such that if both the digital and analog functions are enabled, the analog function
controls the pin.
It is a good programming practice to write to the port data register before changing the direction of a port
pin to become an output. This ensures that the pin will not be driven momentarily with an old data value
that happened to be in the port data register.
6.2
Pin Control — Pullup, Slew Rate and Drive Strength
Associated with the parallel I/O ports is a set of registers located in the high-page register space that
operate independently of the parallel I/O registers. These registers are used to control pullups, slew rate
and drive strength for the pins.
6.3
Pin Behavior in Stop Modes
Pin behavior following execution of a STOP instruction depends on the stop mode that is entered. An
explanation of pin behavior for the various stop modes follows:
Q
D
Q
D
1
0
Port Read
PTxDDn
PTxDn
Output Enable
Output Data
Input Data
Synchronizer
Data
BUSCLK
相关PDF资料 |
PDF描述 |
|---|---|
| MC9S08QD2VPC | 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PDIP8 |
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| MC9S08QE64CQD | 8-BIT, FLASH, 50.33 MHz, MICROCONTROLLER, PQFP44 |
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参数描述 |
|---|---|
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