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参数资料
| 型号： | MC9S08SH4MFKR |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | MICROCONTROLLER, PQCC24 |
| 封装： | 4 X 4 MM, 1 MM HEIGHT, MO-220VGGD-6, QFN-24 |
| 文件页数： | 190/338页 |
| 文件大小： | 3311K |
| 代理商： | MC9S08SH4MFKR |
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Chapter 2 Pins and Connections
MC9S08SH8 MCU Series Data Sheet, Rev. 3
Freescale Semiconductor
27
The voltage measured on the internally pulled up RESET pin will not be
pulled to VDD. The internal gates connected to this pin are pulled to VDD.If
the RESET pin is required to drive to a VDD level an external pullup should
be used.
NOTE
In EMC-sensitive applications, an external RC lter is recommended on the
RESET. See Figure 2-5 for an example.
2.2.4
Background / Mode Select (BKGD/MS)
During a power-on-reset (POR) or background debug force reset (see Section 5.7.3, “System Background
Debug Force Reset Register (SBDFR),” for more information), the PTA4/ACMPO/BKGD/MS pin
functions as a mode select pin. Immediately after any reset, the pin functions as the background pin and
can be used for background debug communication. When enabled as the BKGD/MS pin (BKGDPE = 1),
an internal pullup device is automatically enabled.
The background debug communication function is enabled when BKGDPE in SOPT1 is set. BKGDPE is
set following any reset of the MCU and must be cleared to use the PTA4/ACMPO/BKGD/MS pin’s
alternative pin function.
If nothing is connected to this pin, the MCU will enter normal operating mode at the rising edge of the
internal reset after a POR or force BDC reset. If a debug system is connected to the 6-pin standard
background debug header, it can hold BKGD/MS low during a POR or immediately after issuing a
background debug force reset, which will force the MCU to active background mode.
The BKGD pin is used primarily for background debug controller (BDC) communications using a custom
protocol that uses 16 clock cycles of the target MCU’s BDC clock per bit time. The target MCU’s BDC
clock could be as fast as the maximum bus clock rate, so there must never be any signicant capacitance
connected to the BKGD/MS pin that could interfere with background serial communications.
Although the BKGD pin is a pseudo open-drain pin, the background debug communication protocol
provides brief, actively driven, high speedup pulses to ensure fast rise times. Small capacitances from
cables and the absolute value of the internal pullup device play almost no role in determining rise and fall
times on the BKGD pin.
2.2.5
General-Purpose I/O and Peripheral Ports
The MC9S08SH8 series of MCUs support up to 17 general-purpose I/O pins and 1 output-only pin, which
are shared with on-chip peripheral functions (timers, serial I/O, ADC, etc).
When a port pin is congured as a general-purpose output or a peripheral uses the port pin as an output,
software can select one of two drive strengths and enable or disable slew rate control. When a port pin is
congured as a general-purpose input or a peripheral uses the port pin as an input, software can enable a
pull-up device. Immediately after reset, all of these pins are congured as high-impedance general-purpose
inputs with internal pull-up devices disabled.
相关PDF资料 |
PDF描述 |
|---|---|
| MC9S08SH8MFK | MICROCONTROLLER, PQCC24 |
| MC9S08SH4MSC | MICROCONTROLLER, PDSO8 |
| MC9S08SH8MWJ | MICROCONTROLLER, PDSO20 |
| MC9S08SH4CWJR | MICROCONTROLLER, PDSO20 |
| MC9S08SH4MPJ | MICROCONTROLLER, PDIP20 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC9S08SH4MFKRR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SH4MPJ | 功能描述:8位微控制器 -MCU 9S08 UC W/ 8K 0.25UM SGF RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| MC9S08SH4MPJR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SH4MRSCR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC9S08SH4MRTGR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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