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参数资料
| 型号： | MC9S12C96CPB25 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP52 |
| 封装： | LQFP-52 |
| 文件页数： | 92/138页 |
| 文件大小： | 2318K |
| 代理商： | MC9S12C96CPB25 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页当前第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页
Device User Guide — 9S12C128DGV1/D V01.07
55
2.2 Signal Properties Summary
Table 2-1 Signal Properties
Pin Name
Function 1
Pin Name
Function 2
Pin Name
Function 3
Power
Domain
Internal Pull
Resistor
Description
CTRL
Reset
State
EXTAL
—
VDDPLL
NA
Oscillator pins
XTAL
—
VDDPLL
NA
RESET
—
VDDX
None
External reset pin
XFC
—
VDDPLL
NA
PLL loop lter pin
TEST
VPP
—
VSSX
NA
Test pin only
BKGD
MODC
TAGHI
VDDX
Up
Background debug, mode pin, tag signal high
PE7
NOACC
XCLKS
VDDX
PUCR
Up
Port E I/O pin, access, clock select
PE6
IPIPE1
MODB
VDDX
While RESET
pin is low: Down
Port E I/O pin and pipe status
PE5
IPIPE0
MODA
VDDX
While RESET
pin is low: Down
Port E I/O pin and pipe status
PE4
ECLK
—
VDDX
PUCR
Mode
Dep1
Port E I/O pin, bus clock output
PE3
LSTRB
TAGLO
VDDX
PUCR
Mode
Dep(1)
Port E I/O pin, low strobe, tag signal low
PE2
R/W
—
VDDX
PUCR
Mode
Dep(1)
Port E I/O pin, R/W in expanded modes
PE1
IRQ
—
VDDX
PUCR
Up
Port E input, external interrupt pin
PE0
XIRQ
—
VDDX
PUCR
Up
Port E input, non-maskable interrupt pin
PA[7:3]
ADDR[15:1/
DATA[15:1]
—
VDDX
PUCR
Disabled Port A I/O pin & multiplexed address/data
PA[2:1]
ADDR[10:9/
DATA[10:9]
—
VDDX
PUCR
Disabled Port A I/O pin & multiplexed address/data
PA[0]
ADDR[8]/
DATA[8]
—
VDDX
PUCR
Disabled
Port A I/O pin & multiplexed address/data
PB[7:5]
ADDR[7:5]/
DATA[7:5]
—
VDDX
PUCR
Disabled Port B I/O pin & multiplexed address/data
PB[4]
ADDR[4]/
DATA[4]
—
VDDX
PUCR
Disabled
Port B I/O pin & multiplexed address/data
PB[3:0]
ADDR[3:0]/
DATA[3:0]
—
VDDX
PUCR
Disabled Port B I/O pin & multiplexed address/data
PAD[7:0]
AN[7:0]
—
VDDA
PERAD/P
PSAD
Disabled
Port AD I/O pins and ATD inputs
PP[7]
KWP[7]
—
VDDX
PERP/
PPSP
Disabled Port P I/O Pins and keypad wake-up
PP[6]
KWP[6]
ROMCTL
VDDX
PERP/
PPSP
Disabled
Port P I/O Pins, keypad wake-up and ROMON
enable.
PP[5]
KWP[5]
PW5
VDDX
PERP/
PPSP
Disabled
Port P I/O Pin, keypad wake-up, PW5 output
PP[4:3]
KWP[4:3]
PW[4:3]
VDDX
PERP/
PPSP
Disabled Port P I/O Pin, keypad wake-up, PWM output
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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