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参数资料
| 型号： | MC9S12E64MPVE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 381/606页 |
| 文件大小： | 0K |
| 描述： | IC MCU 16BIT 64K FLASH 112-LQFP |
| 标准包装： | 60 |
| 系列： | HCS12 |
| 核心处理器： | HCS12 |
| 芯体尺寸： | 16-位 |
| 速度： | 25MHz |
| 连通性： | EBI/EMI，I²C，SCI，SPI |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 92 |
| 程序存储器容量： | 64KB（64K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.35 V ~ 2.75 V |
| 数据转换器： | A/D 16x10b; D/A 2x8b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 112-LQFP |
| 包装： | 托盘 |
| 配用： | M68EVB912E128-ND - BOARD EVAL FOR MC9S12E128/64 |
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Chapter 14 Dual Output Voltage Regulator (VREG3V3V2)
MC9S12E128 Data Sheet, Rev. 1.07
Freescale Semiconductor
441
14.2
External Signal Description
Due to the nature of VREG3V3V2 being a voltage regulator providing the chip internal power supply
voltages most signals are power supply signals connected to pads.
Table 14-1 shows all signals of VREG3V3V2 associated with pins.
NOTE
Check device overview chapter for connectivity of the signals.
14.2.1
VDDR — Regulator Power Input
Signal VDDR is the power input of VREG3V3V2. All currents sourced into the regulator loads flow
through this pin. A chip external decoupling capacitor (100 nF...220 nF, X7R ceramic) between VDDR and
VSSR can smoothen ripple on VDDR.
For entering shutdown mode, pin VDDR should also be tied to ground on devices without a VREGEN pin.
14.2.2
VDDA, VSSA — Regulator Reference Supply
Signals VDDA/VSSA which are supposed to be relatively quiet are used to supply the analog parts of the
regulator. Internal precision reference circuits are supplied from these signals. A chip external decoupling
capacitor (100 nF...220 nF, X7R ceramic) between VDDA and VSSA can further improve the quality of this
supply.
Table 14-1. VREG3V3V2 — Signal Properties
Name
Port
Function
Reset State
Pull Up
VDDR
—
VREG3V3V2 power input (positive supply)
—
VDDA
—
VREG3V3V2 quiet input (positive supply)
—
VSSA
—
VREG3V3V2 quiet input (ground)
—
VDD
—
VREG3V3V2 primary output (positive supply)
—
VSS
—
VREG3V3V2 primary output (ground)
—
VDDPLL
—
VREG3V3V2 secondary output (positive supply)
—
VSSPLL
—
VREG3V3V2 secondary output (ground)
—
VREGEN (optional)
—
VREG3V3V2 (Optional) Regulator Enable
—
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