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参数资料
型号： MC9S12GC16CPBE
厂商： Freescale Semiconductor
文件页数： 126/690页
文件大小： 0K
描述： IC MCU 16K FLASH 25MHZ 52-LQFP
标准包装： 160
系列： HCS12
核心处理器： HCS12
芯体尺寸： 16-位
速度： 25MHz
连通性： EBI/EMI，SCI，SPI
外围设备： POR，PWM，WDT
输入/输出数： 35
程序存储器容量： 16KB（16K x 8）
程序存储器类型： 闪存
RAM 容量： 1K x 8
电压 - 电源 (Vcc/Vdd)： 2.35 V ~ 5.5 V
数据转换器： A/D 8x10b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 52-LQFP
包装： 托盘
产品目录页面： 730 (CN2011-ZH PDF)
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Chapter 7 Debug Module (DBGV1) Block Description
Freescale Semiconductor
MC9S12C-Family / MC9S12GC-Family
211
Rev 01.24
7.3.2.11
Debug Comparator B Extended Register (DBGCBX)
7.3.2.12
Debug Comparator B Register (DBGCB)
Module Base + 0x002D
76543210
R
PAGSEL
EXTCMP
W
Reset
0
00000
Figure 7-19. Debug Comparator B Extended Register (DBGCBX)
Table 7-22. DBGCBX Field Descriptions
Field
Description
7:6
PAGSEL
Page Selector Field — If DBGEN is set in DBGC1, then PAGSEL selects the type of paging as shown in Table 7-
11.
DPAGE and EPAGE are not yet implemented so the value in bit 7 will be ignored (i.e., PAGSEL values of 10 and
11 will be interpreted as values of 00 and 01, respectively.)
In BKP mode, PAGSEL has no meaning and EXTCMP[5:0] are compared to address bits [19:14] if the address
is in the FLASH/ROM memory space.
5:0
EXTCMP
Comparator B Extended Compare Bits — The EXTCMP bits are used as comparison address bits as shown
in Table 7-11 along with the appropriate PPAGE, DPAGE, or EPAGE signal from the core. Also see Table 7-20.
Module Base + 0x002E
Starting address location affected by INITRG register setting.
15
14
13
12
11
10
9
8
R
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
W
Reset
0
00000
Figure 7-20. Debug Comparator B Register High (DBGCBH)
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PDF描述
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参数描述
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