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参数资料
型号： MC9S12KG32MFU
厂商： FREESCALE SEMICONDUCTOR INC
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP80
封装： QFP-80
文件页数： 80/126页
文件大小： 6758K
代理商： MC9S12KG32MFU
Device User Guide — 9S12KT256DGV1/D V01.09
57
Freescale Semiconductor
2.2 Signal Properties Summary
(Table 2-1) summarizes the pin functionality. Signals shown in bold are not available in the 80 pin
package. (Table 2-2) summarizes the power and ground pins.
Table 2-1 Signal Properties
Pin Name
Function 1
Pin Name
Function 2
Pin Name
Function 3
Pin Name
Function 4
Powered
by
Internal Pull
Resistor
Description
CTRL
Reset
State
EXTAL
—
VDDPLL
NA
Oscillator Pins
XTAL
—
VDDPLL
NA
RESET
—
VDDR
None
External Reset
TEST
—
NA
Test Input
VREGEN
—
VDDX
NA
Voltage Regulator Enable Input
XFC
—
VDDPLL
NA
PLL Loop Filter
BKGD
TAGHI
MODC
—
VDDR
Always
Up
Background Debug, Tag High, Mode
Input
PAD[15:8]
AN[15:8]
AN1[7:0]1
—
VDDA
None
Port AD Input, Analog Inputs of ATD
in MC9S12KG128(64)(32),
MC9S12KL128(64) and
MC9S12KC128(64); Analog Inputs of
ATD1 in MC9S12KT256 and
MC9S12KG256
PAD[7:0]
AN[7:0]
AN0[7:0]1
—
VDDA
None
Port AD Input, Analog Inputs of ATD in
MC9S12KG128(64)(32),
MC9S12KL128(64) and
MC9S12KC128(64); Analog Inputs of
ATD0 in MC9S12KT256 and
MC9S12KG256
PA[7:0]
ADDR[15:8]/
DATA[15:8]
—
VDDR
PUCR
Disabled Port A I/O, Multiplexed Address/Data
PB[7:0]
ADDR[7:0]/
DATA[7:0]
—
VDDR
PUCR
Disabled Port B I/O, Multiplexed Address/Data
PE7
NOACC
XCLKS
—
VDDR
PUCR
Up
Port E I/O, Access, Clock Select
PE6
IPIPE1
MODB
—
VDDR
While RESET
pin is low:
Down
Port E I/O, Pipe Status, Mode Input
PE5
IPIPE0
MODA
—
VDDR
While RESET
pin is low:
Down
Port E I/O, Pipe Status, Mode Input
PE4
ECLK
—
VDDR
PUCR
Up
Port E I/O, Bus Clock Output
PE3
LSTRB
TAGLO
—
VDDR
PUCR
Up
Port E I/O, Byte Strobe, Tag Low
PE2
R/W
—
VDDR
PUCR
Up
Port E I/O, R/W in expanded modes
PE1
IRQ
—
VDDR
Always Up
Port E Input, Maskable Interrupt
PE0
XIRQ
—
VDDR
Port E Input, Non Maskable Interrupt
PH7
KWH7
SS2
—
VDDR
PERH/
PPSH
Disabled Port H I/O, Interrupt, SS of SPI2
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