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参数资料
| 型号： | MCF5307FT90B |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 14/484页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT COLDF 90MHZ 208FQFP |
| 标准包装： | 24 |
| 系列： | MCF530x |
| 核心处理器： | Coldfire V3 |
| 芯体尺寸： | 32-位 |
| 速度： | 90MHz |
| 连通性： | EBI/EMI，I²C，UART/USART |
| 外围设备： | DMA，POR，WDT |
| 输入/输出数： | 16 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 208-BFQFP |
| 包装： | 托盘 |
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4-12
MCF5307 User’s Manual
Cache Operation
be deallocated and replaced. First the cache controller looks for an invalid line, with way 0
the highest priority. If all lines have valid data, a 2-bit replacement counter is used to choose
the way. After a line is allocated, the pointer increments to point to the next way.
Cache lines from ways 0 and 1 can be protected from deallocation by enabling half-cache
locking. If CACR[HLCK] = 1, the replacement pointer is restricted to way 2 or 3.
As part of deallocation, a valid, unmodied cache line is invalidated. It is consistent with
system memory, so memory does not need to be updated. To deallocate a modied cache
line, data is placed in a push buffer (for an external cache line push) before being
invalidated. After invalidation, the new entry can replace it. The old cache line may be
written after the new line is read.
When a cache line is selected to host a new cache entry, the following three things happen:
1. The new address tag bits A[31:11] are written to the tag.
2. The cache line is updated with the new memory data.
3. The cache line status changes to a valid state (V = 1).
Read cycles that miss in the cache allocate normally as previously described.
Write cycles that miss in the cache do not allocate on a cacheable write-through region, but
do allocate for addresses in a cacheable copyback region.
A copyback byte, word, longword, or line write miss causes the following:
1. The cache initiates a line ll or ush.
2. Space is allocated for a new line.
3. V and M are both set to indicate valid and modied.
4. Data is written in the allocated space. No write to memory occurs.
Note the following:
Read hits cannot change the status bits and no deallocation or replacement occurs;
the data or instructions are read from the cache.
If the cache hits on a write access, data is written to the appropriate portion of the
accessed cache line. Write hits in cacheable, write-through regions generate an
external write cycle and the cache line is marked valid, but is never marked modied.
Write hits in cacheable copyback regions do not perform an external write cycle; the
cache line is marked valid and modied (V = 1 and M = 1).
Misaligned accesses are broken into at least two cache accesses.
Validity is provided only on a line basis. Unless a whole line is loaded on a cache
miss, the cache controller does not validate data in the cache line.
Write accesses designated as cache-inhibited by the CACR or ACR bypass the cache and
perform a corresponding external write.
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Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MCF5307TR | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:UART MODULE |
| MCF5327 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor |
| MCF5327CVM240 | 功能描述:微处理器 - MPU MCF5329 V2-CORE RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
| MCF5327CVM240J | 制造商:Freescale Semiconductor 功能描述:MPC5XXX RISC 32-BIT CMOS 240MHZ 196-PIN MA-BGA TRAY - Trays |
| MCF5328 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor |
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