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参数资料
| 型号： | MCHC908JW32FC |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 67/232页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32K FLASH 8MHZ 48-QFN |
| 标准包装： | 260 |
| 系列： | HC08 |
| 核心处理器： | HC08 |
| 芯体尺寸： | 8-位 |
| 速度： | 8MHz |
| 连通性： | SPI，USB |
| 外围设备： | LED，LVD，POR，PWM |
| 输入/输出数： | 29 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3.5 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 48-VFQFN 裸露焊盘 |
| 包装： | 托盘 |
| 产品目录页面： | 726 (CN2011-ZH PDF) |
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USB Module Registers
MC68HC908JW32 Data Sheet, Rev. 6
Freescale Semiconductor
159
DVALID_OUT — Data valid enable bit for OUT packet
This bit indicates valid data is stored in the endpoint buffer, CPU attention is required. User must clear
this bit in order to receive the next OUT packet by writing zero to the bit, otherwise all successive OUT
packet is NAK by the module. Writing one to the bit has no effect. Reset clears this bit.
1 = Data in the EP0 buffer is valid
0 = Data in the EP0 buffer is not valid
TFRC_OUT — Transfer Complete Flag for OUT packet
This read/write bit indicates the a valid OUT or SETUP packet is completely transferred to the EP0
data buffer. When the bit is set, all successive OUT packet will be responded by NAK. Writing zero to
clear this bit. Writing one to the bit has no effect.
1 = Endpoint data transfer completed
0 = Default status
11.5.5 USB Endpoint 1–4 Control Status Register (UEP1CSR–UEP4CSR)
TFRC — Transfer Complete Flag
This read/write bit indicates the data transfer associated with the endpoint is completed. When the bit
is set, all successive IN/OUT packet will be responded by NAK. Writing zero to clear this bit. Writing
one to the bit has no effect.
1 = Endpoint data transfer completed
0 = Default status
DVALID — Data valid bit
When the endpoint is configured as IN endpoint, this bit indicates the data in the endpoint buffer is valid
and ready to be sent. Setting this bit arms the data transmission otherwise all IN packets are returned
by NAK. The bit will be cleared automatically by hardware when a successful IN packet transaction
occurred.
When the endpoint is configured as OUT endpoint, this bit indicates valid received data is stored in the
endpoint buffer, CPU attention is required. User must clear this bit in order to receive the next OUT
packet, otherwise all successive OUT packet is responded NAK by the module. Reset clears this bit.
1 = Data in the endpoint buffer is valid
0 = Data in the endpoint buffer is not valid
Address:
$0055 to $0058
Bit 7
654321
Bit 0
Read:
MODE1
MODE0
0
DIR
SIZE1
SIZE0
DVALID
TFRC
Write:
STALL
Reset:
00000000
Figure 11-7. USB Endpoint 1–4 Control Status Register
相关PDF资料 |
PDF描述 |
|---|---|
| MCHC908MR8MFAE | IC MCU 8K FLASH 8MHZ PWM 32-LQFP |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MCHC908JW32FCR | 制造商:Freescale Semiconductor 功能描述:8-BIT HC08 CISC 32KB FLASH 5V 48-PIN QFN EP T/R - Tape and Reel |
| MCHC908JW32FHE | 制造商:Rochester Electronics LLC 功能描述: 制造商:Freescale Semiconductor 功能描述: |
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