参数资料
型号: MCIMX257CJM4
厂商: Freescale Semiconductor
文件页数: 130/153页
文件大小: 0K
描述: MPU IMX25 IND 400-MAPBGA
特色产品: MCIMX25 Applications Processors
标准包装: 90
系列: i.MX25
核心处理器: ARM9
芯体尺寸: 32-位
速度: 400MHz
连通性: 1 线,CAN,EBI/EMI,以太网,I²C,MMC,智能卡,SPI,SSI,UART/USART,USB OTG
外围设备: DMA,I²S,LCD,POR,PWM,WDT
输入/输出数: 128
程序存储器类型: 外部程序存储器
RAM 容量: 144K x 8
电压 - 电源 (Vcc/Vdd): 1.15 V ~ 1.52 V
数据转换器: A/D 3x12b
振荡器型: 外部
工作温度: -40°C ~ 85°C
封装/外壳: 400-LFBGA
包装: 托盘
i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 10
78
Freescale Semiconductor
NOTE
All configuration parameters (CSA, CSN, EBWA, EBWN, LBA, LBN,
LAH, OEN, OEA, EBRA, and EBRN) are in cycle units.
1 For the value of parameters WE4–WE21, see column BCD = 0 in Table 56.
2 CS Assertion. This bit field determines when the CS signal is asserted during read/write cycles.
3 CS Negation. This bit field determines when the CS signal is negated during read/write cycles.
4 BE Assertion. This bit field determines when the BE signal is asserted during read cycles.
5 BE Negation. This bit field determines when the BE signal is negated during read cycles.
6 Output maximum delay from internal driving ADDR/control FFs to chip outputs.
7 Output maximum delay from CS[x] internal driving FFs to CS[x] out.
8 DATA maximum delay from chip input data to its internal FF.
9 DTACK maximum delay from chip dtack input to its internal FF.
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PDF描述
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