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参数资料
| 型号： | MCZ33291LEGR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 7/26页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH 8X LOSIDE W/SPI 24SOIC |
| 标准包装： | 1 |
| 类型： | 低端 |
| 输入类型： | SPI |
| 输出数： | 8 |
| 导通状态电阻： | 1.1 欧姆 |
| 电流 - 输出 / 通道： | 500mA |
| 电流 - 峰值输出： | 3A |
| 电源电压： | 9 V ~ 26.5 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 24-SOIC W |
| 包装： | 标准包装 |
| 其它名称： | MCZ33291LEGR2DKR |
ELECTRICAL CHARACTERISTICS
STATIC ELECTRICAL CHARACTERISTICS
Table 4. Static Electrical Characteristics (continued)
Characteristics noted under conditions 4.5 V ≤ V DD ≤ 5.5 V, 9.0 V ≤ V PWR ≤ 16 V, -40 ° C ≤ T A ≤ 125 ° C, unless otherwise noted.
Typical values noted reflect the approximate value with V BAT = 13 V, T A = 25 ° C.
Characteristic
Symbol
Min
Typ
Max
Unit
Output Clamp Voltage
V OK
V
2.0 A < I OUT < 200 mA
45
53
65
Output Leakage Current (V DD < 2.0 V) (20)
I OUT(LKG)
-25
0
25
μ A
Over-temperature Shutdown (Outputs OFF)
(21)
T LIM
155
180
–
° C
Over-temperature Shutdown Hysteresis
(21)
T LIM(HYS)
–
10
20
° C
DIGITAL INTERFACE
Input Logic High Voltage (22)
Input Logic Low Voltage (22)
Input Logic Threshold Hysteresis (SCLK, RST , and SFPD) (23)
SI Pull-up Current (SI = 0 V)
CS Pull-up Current ( CS = 0 V)
SCLK Pull-down Current (SCLK = 5.0 V)
RST Pull-down Current ( RST = 5.0 V)
SFPD Pull-down Current (SFPD = 5.0 V)
V IH
V IL
V I (HYS)
I SI
I CS
I SCLK
I RST
I SFPD
0.7
0
50
0
0
0
5.0
5.0
–
–
100
10
10
10
25
10
1.0
0.2
500
20
20
20
50
25
V DD
V DD
mV
μ A
μ A
μ A
μ A
μ A
SO High-state Output Voltage (I OH = 1.0 mA)
V SOH
V DD - 0.4 V V DD - 0.2 V
–
V
SO Low-state Output Voltage (I OL = -1.6 mA)
SO Tri-state Leakage Current ( CS = 0.7 VDD, 0 V < V SO < V DD )
Input Capacitance (0 V < V DD < 5.5 V) (24)
V SOL
I SOT
C IN
–
-10
–
0.2
0
–
0.4
10
12
V
μ A
pF
SO Tri-state Capacitance (0 V < V DD < 5.5 V)
C SOT
–
–
20
pF
Notes
20.
21.
22.
23.
24.
25.
Output leakage current measured with the output OFF and at 16 V.
This parameter is guaranteed by design, but it is not production tested.
Upper and lower logic threshold voltage levels apply to SI, CS , SCLK, RST , and SFPD inputs.
Hysteresis is characterized, but it is not production tested.
Input capacitance of SI CS , SCLK, RST , and SFPD for 0 V < V DD < 5.5 V. This parameter is guaranteed by design, but it is not production
tested.
Tri-state capacitance of SO for 0 V < V DD < 5.5 V. This parameter is guaranteed by design, but it is not production tested.
33291L
Analog Integrated Circuit Device Data
Freescale Semiconductor
7
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参数描述 |
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