参数资料
型号: MFR4200MAE40R
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 2 CHANNEL(S), 10M bps, SERIAL COMM CONTROLLER, PQFP64
封装: 10 X 10 MM, 1.40 MM HEIGHT, 0.50 PITCH, LEAD FREE, MS-026BCD, LQFP-64
文件页数: 99/260页
文件大小: 1599K
代理商: MFR4200MAE40R
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MFR4200 FlexRay Communication Controller
MFR4200 Data Sheet, Rev. 1
188
Freescale Semiconductor
To read a receive FIFO buffer, the host must lock the FIFO buffer by sending a lock request (LOCK=’1’)
to message buffer 0. When a FIFO buffer is locked (read back value of the LOCK=’1’), the message buffer
addressed by GETIDX appears in the active receive FIFO buffer. After reading, the FIFO buffer must be
unlocked, and the GETIDX pointer is incremented.
The complete set of FIFO acceptance/rejection filters consists of the following registers (see
Two filter sets are available for FIFO filtering:
One FIFO acceptance filter set, comprising:
— FIFO acceptance filter message ID value register
— FIFO acceptance filter message ID mask register
One FIFO rejection filter set, comprising:
— FIFO rejection filter frame ID value register
— FIFO rejection filter frame ID mask register
The channels from which the received frame will be accepted or rejected by the FIFO
acceptance/rejection filters are specified in Section 3.2.3.8.7, “FIFO Acceptance/Rejection Filter
The FIFO acceptance filter value registers define the acceptable pattern of the frame to be received. The
FIFO acceptance filter mask registers specify which of the corresponding bits are marked ‘don’t care’ for
acceptance filtering.
The FIFO rejection filter value registers define the acceptable pattern of the frame to be rejected. The FIFO
rejection filter mask registers specify which of the corresponding bits are marked ‘don’t care’ for rejection
filtering.
If acceptance and rejection filter are configured to match the same identifier, the frame will be rejected.
NOTE
The content of the FIFO is not reset by entering, being in, or leaving the
configuration state. Therefore, if the CC has stored any messages in the
FIFO, and has entered the configuration state without reading those
messages, and has returned to normal operation, then those messages
will remain in the FIFO.
The CC automatically updates the BUFCSnR registers of the FIFO
buffers to 0x0 values when the CC enters the configuration state for the
first time.
The host must clear buffer control flags CFG, IFLG, and IENA (write
0x0000 to the buffer control register) of a message buffer that has
already been in use or that has already been configured, before the host
may extend the FIFO (alter the FIFO size) to include that message buffer
in the FIFO. Failing to do so will result in invalid indications in the
RBIVEC/TBIVEC registers (see Section 3.2.3.6.1, “Receive Buffer
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PDF描述
MFR4200MPB40 2 CHANNEL(S), 10M bps, SERIAL COMM CONTROLLER, PQFP64
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MFR4310E1MAE40 2 CHANNEL(S), 10M bps, SERIAL COMM CONTROLLER, PQFP64
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MFR4-220RFI 制造商:TT Electronics / Welwyn 功能描述:RESISTOR METAL FILM 220 OHM 500mW 1% 制造商:TT Electronics / Welwyn 功能描述:RESISTOR, METAL FILM, 220 OHM, 500mW, 1% 制造商:TT ELECTRONICS 功能描述:RESISTOR, METAL FILM, 220 OHM, 500mW, 1%, Product Range:WELWYN - MFR Series, Res 制造商:TT Electronics / Welwyn 功能描述:RESISTOR, METAL FILM, 220 OHM, 500mW, 1%, Product Range:WELWYN - MFR Series, Resistance:220ohm, Power Rating:500mW, Resistance Tolerance: 1%, Resistor Case Style:Axial Leaded, Resistor Element Type:Metal Film, Voltage Rating:350V , RoHS Compliant: Yes