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参数资料
| 型号： | MFR4300MAE40 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 10M bps, SERIAL COMM CONTROLLER, PQFP64 |
| 封装： | 10 X 10 MM, 1.40 MM HEIGHT, 0.50 PITCH, LEAD FREE, MS-026BCD, LQFP-64 |
| 文件页数： | 265/266页 |
| 文件大小： | 1701K |
| 代理商： | MFR4300MAE40 |
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FlexRay Module (FLEXRAYV2)
MFR4300 Data Sheet, Rev. 3
98
Freescale Semiconductor
3.3.2.30
Sync Frame Counter Register (SFCNTR)
This register provides the number of synchronization frames that are used for clock synchronization in the
last even and in the last odd numbered communication cycle. This register is updated after the NIT start
and before 10 MT after offset correction start.
NOTE
If the application has locked the even synchronization table at the end of the
static segment of an even communication cycle, the FlexRay module will
not update the fields SFEVB and SFEVA.
If the application has locked the odd synchronization table at the end of the
static segment of an odd communication cycle, the FlexRay module will not
update the values SFODB and SFODA.
3.3.2.31
Sync Frame Table Offset Register (SFTOR)
This register defines the FRM related offset for Sync Frame Tables. For more details, see Section 3.4.12,
0x0040
Additional Reset: RUN Command
15
14
13
12
11
10
98
76543
210
R
SFEVB
SFEVA
SFODB
SFODA
W
Reset
000000
00000
Figure 3-29. Sync Frame Counter Register (SFCNTR)
Table 3-36. SFCNTR Field Descriptions
Field
Description
15–12
SFEVB
Sync Frames Channel B, even cycle — protocol related variable: size of (vsSyncIdListB for even cycle)
This field provides the size of the internal list of frame IDs of received synchronization frames used for clock
synchronization.
11–8
SFEVB
Sync Frames Channel A, even cycle — protocol related variable: size of (vsSyncIdListA for even cycle)
This field provides the size of the internal list of frame IDs of received synchronization frames used for clock
synchronization.
7–4
SFODB
Sync Frames Channel B, odd cycle — protocol related variable: size of (vsSyncIdListB for odd cycle)
This field provides the size of the internal list of frame IDs of received synchronization frames used for clock
synchronization.
3–0
SFODA
Sync Frames Channel A, odd cycle — protocol related variable: size of (vsSyncIdListA for odd cycle)
This field provides the size of the internal list of frame IDs of received synchronization frames used for clock
synchronization.
0x0042
Write: POC:config
15
14
13
12
11
10
98
76543
210
R
SFT_OFFSET[15:1]
0
W
Reset
000000
00000
Figure 3-30. Sync Frame Table Offset Register (SFTOR)
相关PDF资料 |
PDF描述 |
|---|---|
| MG80C18612883B | 16-BIT, 12.5 MHz, MICROPROCESSOR, CPGA68 |
| MG80C186-10 | 16-BIT, 10 MHz, MICROPROCESSOR, CPGA68 |
| MQ80C186-12 | 16-BIT, 12.5 MHz, MICROPROCESSOR, CQFP68 |
| MII-266 | 32-BIT, 266 MHz, MICROPROCESSOR, CPGA296 |
| MII-350 | 32-BIT, 350 MHz, MICROPROCESSOR, CPGA296 |
相关代理商/技术参数 |
参数描述 |
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| MFR4-330RFC | 制造商:TT Electronics / Welwyn 功能描述:Res Metal Film 330 Ohm 1% 1/2W ±50ppm/°C Conformal AXL Thru-Hole Ammo Pack |
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