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参数资料
| 型号： | MK1573-02STR |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 60.41957 MHz, VIDEO CLOCK GENERATOR, PDSO16 |
| 封装： | 0.150 INCH, SOIC-16 |
| 文件页数： | 5/6页 |
| 文件大小： | 84K |
| 代理商： | MK1573-02STR |
MK1573-02
GenClock HSYNC to Video Clock
MDS 1573-02 B
5
Revision 120497
Printed 11/15/00
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA 95126(408)295-9800telwww.icst.com
Clock Waveforms
In addition to generating the video clock on CLK1 (pin 10), the MK1573 also outputs the recovered
HSYNC clocks. On certain selections, a double speed recovered HSYNC clock is also available. These
recovered clocks will have lower jitter than the HSYNC input due to the filtering action of the PLL. The
jitter spectrum of the recovered clocks will be reduced at frequencies higher than the loop bandwidth. The
above section describes how to calculate the approximate loop bandwidth. The waveforms of the
recovered clocks fall into one of three different groups depending on the address selection:
HSYNC
input
CLK3
Addresses 0 to 7 and C
HSYNC
input
CLK3
Addresses D, E, and F
CLK2
The recovered clocks are triggered by the falling edge of HSYNC and are delayed by about 100ns.
HSYNC
input
CLK3
Addresses A and B
CLK2
相关PDF资料 |
PDF描述 |
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| M48T02-200PC1 | 0 TIMER(S), REAL TIME CLOCK, PDIP24 |
| M48T35Y-70PC1 | 0 TIMER(S), REAL TIME CLOCK, PDIP28 |
| M48T559YMH1TR | 0 TIMER(S), REAL TIME CLOCK, PDSO28 |
相关代理商/技术参数 |
参数描述 |
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