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参数资料
| 型号： | MK1574-01ASILF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 1574 SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封装： | 0.150 INCH, ROHS COMPLIANT, SOIC-16 |
| 文件页数： | 1/11页 |
| 文件大小： | 239K |
| 代理商： | MK1574-01ASILF |
DATASHEET
FRAME RATE COMMUNICATIONS PLL
MK1574-01A/B
IDT / ICS FRAME RATE COMMUNICATIONS PLL
1
MK1574-01A/B
REV D 051310
Description
The MK1574-01A/B are Phase-Locked Loop (PLL) based
clock synthesizers, which accept an 8 kHz clock input as a
reference, and generate many popular communications
frequencies. All outputs are frequency locked together and
to the input. This allows for the generation of locked clocks
to the 8 kHz backplane clock, simplifying clock generation
and distribution in communications systems.
1) MK1574-01A — 5 V operation
2) MK1574-01B — 3.3 V operation
IDT manufactures the largest variety of clock generators
and buffers, and can customize this device for a variety of
frequencies.
Features
Packaged in 16-pin SOIC
Accepts 8 kHz input clock
Output clock rates include T1, E1, T2, E2
Available in commercial (0 to + 70C) or industrial (-40 to
+85C) temperature ranges
For jitter attenuation, use the MK2049
Block Diagram
Input
Buffer
CLK1
PLL Clock
Synthesis
and Control
Circuitry
8 kHz
input
clock
FS0-3
4
VDD
2
GND
2
CLK2
CLK3
8 kHz
(recovered)
CAP1
CAP2
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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