参数资料
型号: MK2049-36SILF
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 155.52 MHz, OTHER CLOCK GENERATOR, PDSO20
封装: 0.300 INCH, ROHS COMPLIANT, SOIC-20
文件页数: 2/8页
文件大小: 89K
代理商: MK2049-36SILF
MK2049-36
3.3 VOLT COMMUNICATIONS CLOCK PLL
VCXO AND SYNTHESIZER
IDT 3.3 VOLT COMMUNICATIONS CLOCK PLL
2
MK2049-36
REV G 051310
Pin Assignment
20 pin (300) mil SOIC
Pin Descriptions
16
1
15
2
14
FS1
FS0
3
13
X2
4
12
X1
RES
5
11
VDD
6
CAP2
7
FCAP
8
VDD
GND
CAP1
VDD
GND
CLK
ICLK
9
10
CLK/2
FS3
8k
FS2
20
19
18
17
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
FS1
Input
Frequency select 1. Determines CLK input/outputs per table on page 3.
Internal pull-up resistor.
2
X2
XO
Crystal connection. Connect to a MHz crystal as shown in table on page 3.
3
X1
XI
Crystal connection. Connect to a MHz crystal as shown in table on page 3.
4
VDD
Power
Power supply. Connect to +3.3 V.
5
FCAP
-
Filter capacitor. Connect a 1000 pF ceramic capacitor to ground.
6
VDD
Power
Power supply. Connect to +3.3 V.
7
GND
Power
Connect to ground
8
CLK
Output
Clock output determined by status of FS3:0 per tables on page 3.
9
CLK/2
Output
Clock output determined by status of FS3:0 per tables page 3. Always 1/2 of
CLK.
10
8k
Output
Recovered 8 kHz clock output.
11
FS2
Input
Frequency select 2. Determines CLK input/outputs per tables on page 3.
Internal pull-up resistor.
12
FS3
Input
Frequency select 3. Determines CLK input/outputs per tables on page 3.
Internal pull-up resistor.
13
ICLK
Input
Input clock connection. Connect to 8 kHz backplane or MHz clock.
14
GND
Power
Connect to ground.
15
VDD
Power
Power Supply. Connect to +3.3 V.
16
CAP1
Loop
Filter
Connect the loop filter ceramic capacitors and resistor between this pin and
CAP2.
17
GND
Power
Connect to ground.
18
CAP2
Loop
Connect the loop filter ceramic capacitors and resistor between this pin and
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