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参数资料
| 型号： | MK2308S-1IT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 2308 SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封装： | 0.150 INCH, SOIC-16 |
| 文件页数： | 4/7页 |
| 文件大小： | 187K |
| 代理商： | MK2308S-1IT |
MK2308-1
3.3 VOLT ZERO DELAY, LOW SKEW BUFFER
ZDB
IDT / ICS 3.3 VOLT ZERO DELAY, LOW SKEW BUFFER
4
MK2308-1
REV B 012805
DC Electrical Characteristics
VDD=3.3 V ±10%, Ambient temperature -40 to +85
°C(Industrial), (0-70°C Commercial),
AC Electrical Characteristics
VDD = 3.3 V ±10%, Ambient Temperature -40 to +85
°C(Industrial), (0-70°C Commercial)
Note 1: With CLKIN = 100MHz, FBIN to CLKA4, all outputs at 100 MHz
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
3.0
3.6
V
Input High Voltage
VIH
2V
Input Low Voltage
VIL
0.8
V
Input Low Current
IIL
VIN = 0V
50
A
Input High Current
IIH
VIN = VDD
100
A
Output High Voltage
VOH
IOH = -12 mA
2.4
V
Output Low Voltage
VOL
IOL = 12 mA
0.4
V
Output High Voltage,
CMOS level
VOH
IOH = -4 mA
VDD-0.4
V
Operating Supply Current
IDD
No Load, S2 = 1, S1 = 1,
Note 1
70
mA
Power Down Supply
Current
IDDPD
CLKIN = 0, S2 = 0, S1 = 1
12
A
CLKIN = 0, Note 2
12
A
Short Circuit Current
IOS
Each output
±50
mA
Input Capacitance
CIN
S2, S1, FBIN
5
pF
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Clock Frequency
fIN
See table on page 2
10
133
MHz
Output Clock Frequency
See table on page 2
10
133
MHz
Output Rise Time
tOR
0.8 to 2.0 V, CL=30 pF
1.5
ns
Output Fall Time
tOF
2.0 to 0.8 V, CL=30 pF
1.25
ns
Output Clock Duty Cycle
tDC
measured at VDD/2
45
50
55
%
Device to Device Skew
rising edges at VDD/2
700
ps
Output to Output Skew
rising edges at VDD/2
200
ps
Input to Output Skew
Delay CLKIN Rising Edge to
FBIN Rising Edge
±250
ps
Maximum Absolute Jitter
CL=15 pF, measured at 66.67M
130
ps
Cycle to Cycle Jitter
CL=30 pF, measured at 66.67M
200
ps
CL=15 pF, measured at 66.67M
200
ps
CL=15 pF, measured at
133.33M
100
ps
PLL Lock Time
Note 3
1.0
ms
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