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参数资料
| 型号： | MK2308S-2ILF |
| 元件分类： | 时钟及定时 |
| 英文描述： | 2308 SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封装： | 0.150 INCH, ROHS COMPLIANT, SOIC-16 |
| 文件页数： | 1/5页 |
| 文件大小： | 138K |
| 代理商： | MK2308S-2ILF |
MK2308-2
MDS 2308-2 C
1
Revision 070705
Integrat ed Circuit Systems ● 525 Race Stre et, San Jo se, CA 9 5126 ● te l (40 8 ) 2 97-12 01 ● www.ics t.co m
ZERO DELAY, LOW SKEW BUFFER
Description
The MK2308-2 is a low jitter, low skew, high
performance Phase-Lock Loop (PLL) based zero delay
buffer for high speed applications. Based on ICS’
proprietary low jitter PLL techniques, the device
provides eight low skew outputs at speeds up to 133.3
MHz at 3.3 V. The MK2308-2 includes a bank of four
outputs running at 1/2X. In the zero delay mode, the
rising edge of the input clock is aligned with the rising
edges of all eight outputs. Compared to competitive
CMOS devices, the MK2308-2 has the lowest jitter.
Features
Packaged in 16-pin SOIC
Available in Pb (lead) free package
Zero input-output delay
Four 1X outputs plus four 1/2X outputs
Output to output skew is less than 250 ps
Output clocks up to 133.3 MHz at 3.3 V
Ability to generate 2X the input
Full CMOS outputs with 18 mA output drive
capability at TTL levels at 3.3 V
Spread SmartTM technology works with spread
spectrum clock generators
Advanced, low power, sub micron CMOS process
Operating voltage of 3.3 V
Block Diagram
CLKA4
CLKB1
CLKA3
CLKB2
CLKB3
CLKA2
CLKA1
CLKB4
Control
Logic
S2, S1
2
PLL
FBIN
CLKIN
/2
VDD
2
GND
2
BANK
A
BANK
B
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PDF描述 |
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