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参数资料
| 型号： | MK2308S-2LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 4/6页 |
| 文件大小： | 0K |
| 描述： | IC PLL ZD BUFFER HS 16-SOIC |
| 标准包装： | 240 |
| 类型： | 零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | 时钟 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:8 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 133.3MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 16-SOIC |
| 包装： | 管件 |
| 其它名称： | 800-2631-5 MK2308S-2LF-ND |
MK2308-2
ZERO DELAY, LOW SKEW BUFFER
ZDB
IDT ZERO DELAY, LOW SKEW BUFFER
4
MK2308-2
REV E 051310
AC Electrical Characteristics
VDD = 3.3V ±10%, Temp 0 to +70
°/ -40 to +85° C
Thermal Characteristics
Operating Supply Current
100 MHz, CLKIN
IDD
No Load
S1=S2=1
44
mA
Short Circuit Current
IOS
Each output
± 65
mA
Input Capacitance
CIN
S1, S1, FBIN
7
pF
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
FBIN to CLKA1
S1=S2=1
20
133.
3
MHz
Output Frequency
FBIN to CLKA1
S1=S2=1
20
133.
3
MHz
Output Rise Time
tOR
0.8 to 2.0 V, CL=30 pF
1.5
ns
Output Fall Time
tOF
0.8 to 2.0 V, CL=30 pF
1.5
ns
Output Clock Duty Cycle
at 1.4V
40
50
60
%
Device to Device skew, equally
loaded
rising edges at VDD/2
700
ps
Output to Output skew, equally
loaded
rising edges at VDD/2
200
ps
Maximum Absolute Jitter
300
ps
Cycle to Cycle Jitter
30 pF loads
66.67 MHz outputs
400
ps
15 pF loads
66.67 MHz outputs
400
ps
Skew from Output Bank A to
Output Bank B
All outputs equally
loaded
400
ps
Delay CLKIN Rising Edge to
FBIN Rising Edge
measured at VDD/2
±250
ps
PLL Lock Time
tLOCK
Stable power supply,
valid clocks on CLKIN,
FBIN
1ms
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Thermal Resistance Junction to
Ambient
θJA
Still air
120
° C/W
θJA
1 m/s air flow
115
° C/W
θJA
3 m/s air flow
105
° C/W
Thermal Resistance Junction to Case
θJC
58
° C/W
相关PDF资料 |
PDF描述 |
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参数描述 |
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