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参数资料
| 型号： | MK2712STR |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/4页 |
| 文件大小： | 0K |
| 描述： | IC CLK SOURCE MTSC/PAL 8-SOIC |
| 产品变化通告： | Product Discontinuation 13/May/2009 |
| 标准包装： | 2,500 |
| 类型： | 时钟合成器 - 视频 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 35.469MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 带卷 (TR) |
MK2712
NTSC/PAL Clock Source
MDS 2712 D
3
Revision 092104
Integrated Circuit Systems 525 Race Street San Jose CA 95126 (408)297-1201tel www.icst.com
Notes:
1. Stresses beyond those listed under Absolute Maximum Ratings could cause permanent damage to the device.
Prolonged exposure to levels above the operating limits but below the Absolute Maximums may affect device
reliability.
2. Typical values are at 25°C.
Electrical Specifications
Parameter
Conditions
Minimum
Typical
Maximum
Units
ABSOLUTE MAXIMUM RATINGS (note 1)
Supply Voltage, VDD
Referenced to GND
7
V
Inputs
Referenced to GND
-0.5
VDD+.5V
V
Clock Outputs
Referenced to GND
-0.5
VDD+.5V
V
Ambient Operating Temperature
0
70
°C
Soldering Temperature
Max of 10 seconds
260
°C
Storage temperature
-65
150
°C
DC CHARACTERISTICS (at 5.0V unless otherwise noted)
Operating Voltage, VDD
4.5
5.5
V
Input High Voltage, VIH, input clock only
ICLK pin
3.5
2.5
V
Input Low Voltage, VIL, input clock only
ICLK pin
2.5
1.5
V
Input High Voltage, VIH
2
V
Input Low Voltage, VIL
0.8
V
Output High Voltage, VOH
IOH=-4mA
VDD-0.4
V
Output High Voltage, VOH
IOH=-25mA
2.4
V
Output Low Voltage, VOL
IOL=25mA
0.4
V
Operating Supply Current, IDD
No Load, FS1=1. FS0=1
13
mA
Power Down Supply Current, IDDPD
No Load
10
A
Input Capacitance
5
pF
Actual Mean Frequency versus Target
With exact ICLK
0.3
ppm
AC CHARACTERISTICS (at 5.0V unless otherwise noted)
Input Clock Frequency
27
MHz
Input Clock Duty Cycle
Time above 2.5V
20
80
%
Output Clock Rise Time
0.8 to 2.0V
1.5
ns
Output Clock Fall Time
2.0 to 0.8V
1.5
ns
Output Clock Duty Cycle
Time above 1.5V
40
50
60
%
Absolute Maximum Clock Period Jitter, 15 pF
Variation from mean
± 90
ps
One Sigma Clock Period Jitter, 15 pF load
30
ps
Absolute Maximum Clock Period Jitter, 15 pF
VDD=3.3V
± 180
ps
One Sigma Clock Period Jitter, 15 pF load
VDD=3.3V
50
ps
相关PDF资料 |
PDF描述 |
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