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参数资料
| 型号： | MK2761ASLFTR |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 27 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| 封装： | 0.150 INCH, ROHS COMPLIANT, SOIC-16 |
| 文件页数： | 4/6页 |
| 文件大小： | 136K |
| 代理商： | MK2761ASLFTR |
SET-TOP CLOCK SOURCE
MDS 2761A D
4
Revision 070705
In te gr ated Circuit Systems ● 525 Ra ce Street, San Jose, CA 9512 6 ● tel (4 08) 297-1 201 ● www.icst.com
MK2761A
DC Electrical Characteristics
VDD = 5.0 V ±10% (unless otherwise noted), Temp 0 to +70
°C
Note 1: With ACLK clock at 12.28 MHz.
AC Electrical Characteristics
VDD = 5.0 V ±10% (unless otherwise noted), Temp 0 to +70
°C
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
4.5
5.5
V
Input High Voltage
VIH
X1/ICLK pin only
3.5
2.5
V
Input Low Voltage
VIL
X1/ICLK pin only
2.5
1.5
V
Input High Voltage
VIH
2V
Input Low Voltage
VIL
0.8
V
Output High Voltage
VOH
IOH = -25 mA
2.4
V
Output Low Voltage
VOL
IOL = 25 mA
0.4
V
Output High Voltage, CMOS
level
VOH
IOH = -8 mA
VDD-0.4
V
Operating Supply Current
IDD
No load, Note 1
65
mA
Short Circuit Current
IOS
Each output
±100
mA
Input Capacitance
CIN
7pF
Frequency Error, ACLK
0
ppm
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
27
MHz
Output Clock Rise Time
tOR
0.8 to 2.0 V
1.5
ns
Output Clock Fall Time
tOF
2.0 to 0.8 V
1.5
ns
Output Clock Duty Cycle
At 1.4 V
40
60
%
Absolute Jitter, short term
Variation from mean
±250
ps
Skew of 27 MHz Outputs
Rising edges at 1.4 V
-500
0
500
ps
相关PDF资料 |
PDF描述 |
|---|---|
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| MK2761S | 27 MHz, OTHER CLOCK GENERATOR, PDSO16 |
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| MK2771-05STR | 50 MHz, OTHER CLOCK GENERATOR, PDSO20 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MK2761ASTR | 功能描述:IC CLK SOURCE SET-TOP 16-SOIC RoHS:否 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:39 系列:- 类型:* PLL:带旁路 输入:时钟 输出:时钟 电路数:1 比率 - 输入:输出:1:10 差分 - 输入:输出:是/是 频率 - 最大:170MHz 除法器/乘法器:无/无 电源电压:2.375 V ~ 3.465 V 工作温度:0°C ~ 70°C 安装类型:* 封装/外壳:* 供应商设备封装:* 包装:* |
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