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参数资料
| 型号： | MK2771-16RLFTR |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/7页 |
| 文件大小： | 0K |
| 描述： | IC CLK SRC VCXO/SET-TOP 28-QSOP |
| 标准包装： | 2,500 |
| 类型： | 时钟合成器，VCXO |
| PLL： | 带旁路 |
| 输入： | 晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:8 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 50MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-SSOP（0.154"，3.90mm 宽） |
| 供应商设备封装： | 28-QSOP |
| 包装： | 带卷 (TR) |
MK2771-16
VCXO AND SET-TOP CLOCK SOURCE
VCXO AND SYNTHESIZER
IDT VCXO AND SET-TOP CLOCK SOURCE
3
MK2771-16
REV G 051310
Pin Descriptions
Pin
Number
Pin
Name
Pin Type
Pin Description
1
PS0
Input
Processor clock select 0. Selects PCLK frequency. See table
above. Internal pull-up resistor.
2
X2
XO
Crystal connection. Connect to a 13.5 MHz fundamental mode
pullable crystal.
3, 10, 11
GND
Power
Connect to ground.
4
X1
XI
Crystal connection. Connect to a 13.5 MHz fundamental mode
pullable crystal.
5, 8, 22
VDD5
Power
Connect to +5 V.
6
VIN
Input
Voltage input to VCXO. Zero to 3 V signal which controls the
frequency of the VCXO.
7
VDDIO
Power
Connect to +3.3 V or +5 V. Amplitude of inputs and outputs will
match this.
9
CS1
Input
Communications clock select pin 1. Selects CCLK 1 and 2 per
table above. Internal pull-up.
12
PCLK
Output
Processor clock output. Determined by status of PS1, PS0.
13
CCLK2
Output
Communications clock output 2 determined by status of CS1,
CS0 per table above.
14
ACLK
Output
Audio clock output. Determined by status of AS2:0 per table
above.
15
13.5M
Output
13.5 MHz VCXO clock output.
16
PS1
Tri-level Input Processor Clock Select 1. Selects PCLK frequency. See table
above. Self-biased to M.
17
CCLK1
Output
Communications clock output 1 determined by status of CS1,
CS0 per table above.
18, 23, 25
27M
Output
27 MHz VCXO clock output.
19, 20, 24
GND
Power
Connect to ground.
21
AS2
Input
Audio clock select 2. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
26
CS0
Input
Communications clock select pin 0. Selects CCLK 1 and 2 per
table above. Internal pull-up.
27
AS0
Input
Audio clock select 0. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
28
AS1
Input
Audio clock select 1. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
相关PDF资料 |
PDF描述 |
|---|---|
| MK2771-15RLFTR | IC CLK SRC VCXO/SET-TOP 28-QSOP |
| MK2761ASLFTR | IC CLK SOURCE SET-TOP 16-SOIC |
| ICS581G-01ILFT | IC CLK MUX GLITCH FREE 16-TSSOP |
| SL28PCIE25ALCT | IC CLOCK PCIE GEN3/2 32QFN |
| SL28PCIE25ALC | IC CLOCK PCIE GEN3/2 32QFN |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MK2771-16RTR | 功能描述:IC CLK SRC VCXO/SET-TOP 28-QSOP RoHS:否 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:39 系列:- 类型:* PLL:带旁路 输入:时钟 输出:时钟 电路数:1 比率 - 输入:输出:1:10 差分 - 输入:输出:是/是 频率 - 最大:170MHz 除法器/乘法器:无/无 电源电压:2.375 V ~ 3.465 V 工作温度:0°C ~ 70°C 安装类型:* 封装/外壳:* 供应商设备封装:* 包装:* |
| MK2772-01 | 制造商:ICS 制造商全称:ICS 功能描述:VCXO and Set-Top Clock Source |
| MK2772-01S | 功能描述:IC CLK SRC VCXO/SET-TOP 20-SOIC RoHS:否 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:39 系列:- 类型:* PLL:带旁路 输入:时钟 输出:时钟 电路数:1 比率 - 输入:输出:1:10 差分 - 输入:输出:是/是 频率 - 最大:170MHz 除法器/乘法器:无/无 电源电压:2.375 V ~ 3.465 V 工作温度:0°C ~ 70°C 安装类型:* 封装/外壳:* 供应商设备封装:* 包装:* |
| MK2772-01SLF | 功能描述:时钟合成器/抖动清除器 VCXO AND SET-TOP CLOCK SOURCE RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| MK2772-01SLFTR | 功能描述:时钟合成器/抖动清除器 VCXO AND SET-TOP CLOCK SOURCE RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
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