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参数资料
| 型号： | MK9173-01CS08LF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 9173 SERIES, PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| 封装： | SOIC-8 |
| 文件页数： | 2/7页 |
| 文件大小： | 162K |
| 代理商： | MK9173-01CS08LF |
MK9173-01
MK9173-15
2
Integrated Circuit Systems, Incorporated 525 Race Street San Jose CA 95126 (408) 295-9800 tel www.icst.com
Pin Descriptions
Pin Configuration
Table 1: Allowable Input Frequency to Output Frequency (Outputs in MHz)MK9173-01
(MK9173-15 outputs run at exactly 1/2 the MK9173-01 frequencies)
PIN
NUMBER
PIN NAME
TYPE
DESCRIPTION
1
FBIN
Input
Feedback Input
2
IN
Input
Input for reference sync pulse
3
GND
—
Ground
4
FS0
Input
Frequency Select 0 input
5
OE
Input
Output Enable
6
CLK1
Output
Clock Output 1
7
VDD
—
Power Supply (+5V)
8
CLK2
Output
Clock Output 2 (Divided-by-2 from Clock 1)
fIN (kHz)
fOUT for FS = 0 (MHz)
fOUT for FS = 1 (MHz)
CLK1 Output
CLK2 Output
CLK1 Output
CLK2 Output
12
≤ fIN ≤ 14 kHz
44.0 to 75
22.0 to 37.5
11.0 to 18.75
5.5 to 9.375
14 < fIN
≤ 17 kHz
30.0 to 75
15.0 to 37.5
7.5 to 18.75
3.75 to 9.375
17 < fIN
≤ 30 kHz
25.0 to 75
12.5 to 37.5
6.25 to 18.75
3.125 to 9.375
30 < fIN
≤ 35 kHz
15.0 to 75
7.5 to 37.5
3.75 to 18.75
1.875 to 9.375
35 < fIN
≤ 1000 kHz
10.0 to 75
5.0 to 37.5
2.5 to 18.75
1.25 to 9.375
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PDF描述 |
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