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参数资料
型号： MPC561MZP56R2
厂商： Freescale Semiconductor
文件页数： 143/1420页
文件大小： 0K
描述： IC MPU 32BIT 56MHZ 388-PBGA
标准包装： 500
系列： MPC5xx
核心处理器： PowerPC
芯体尺寸： 32-位
速度： 56MHz
连通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外围设备： POR，PWM，WDT
输入/输出数： 64
程序存储器类型： ROMless
RAM 容量： 32K x 8
电压 - 电源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
数据转换器： A/D 32x10b
振荡器型： 外部
工作温度： -40°C ~ 125°C
封装/外壳： 388-BBGA
包装： 带卷 (TR)
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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Internal Memory Map
MPC561/MPC563 Reference Manual, Rev. 1.2
B-16
Freescale Semiconductor
0x30 4F00 –
0x30 4F7E
S/U
LJSRR_B
Result Word Table.
Left-Justified, Signed Result Register.
16
X
0x30 4F80 –
0x30 4FFE
S/U
LJURR_B
Result Word Table.
Left-Justified, Unsigned Result Register.
16
X
1 Bit 3 (SSEx) is readable in test mode only.
Table B-11. QSMCM (Queued Serial Multi-Channel Module)
Address
Access
Symbol
Register
Size
Reset
QSMCM
0x30 5000
S
QSMCMMCR
QSMCM Module Configuration Register.
See Table 15-4 for bit descriptions.
16
S
0x30 5002
T
QTEST
QSMCM Test Register
16
S
0x30 5004
S
QDSCI_IL
Dual SCI Interrupt Level.
See Table 15-5 for bit descriptions.
16
S
0x30 5006
S
QSPI_IL
Queued SPI Interrupt Level.
See Table 15-6 for bit descriptions.
16
S
0x30 5008
S/U
SCC1R0
SCI1 Control Register 1.
See Table 15-24 for bit descriptions.
16
S
0x30 500A
S/U
SCC1R1
SCI1 Control Register 1.
See Table 15-25 for bit descriptions.
16
S
0x30 500C
S/U
SC1SR
SCI1 Status Register.
See Table 15-26 for bit descriptions.
16
S
0x30 500E
S/U
SC1DR
SCI1 Data Register.
See Table 15-27 for bit descriptions.
16
S
0x30 5010 —
0x30 5012
——
Reserved
—
0x30 5014
S/U
PORTQS
QSMCM Port QS Data Register.
See Section 15.5.2 for bit descriptions.
16
S
0x30 5016
S/U
PQSPAR/
DDRQST
QSMCM Port QS PIn Assignment Register/
QSMCM Port QS Data Direction Register.
See Section 15.5.2 for bit descriptions.
16
S
0x30 5018
S/U
SPCR0
QSPI Control Register 0.
See Table 15-13 for bit descriptions.
16
S
0x30 501A
S/U
SPCR1
QSPI Control Register 1.
See Table 15-15 for bit descriptions.
16
S
0x30 501C
S/U
SPCR2
QSPI Control Register 2.
See Table 15-16 for bit descriptions.
16
S
0x30 501E
S/U
SPCR3
QSPI Control Register 3.
See Table 15-17 for bit descriptions.
8S
Table B-10. QADC64E A and B (Queued Analog-to-Digital Converter) (continued)
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参数描述
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