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参数资料
| 型号： | MPC8265ACZUMIBB |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 266 MHz, RISC PROCESSOR, PBGA480 |
| 封装： | 37.5 X 37.5 MM, TBGA-480 |
| 文件页数： | 23/111页 |
| 文件大小： | 1007K |
| 代理商： | MPC8265ACZUMIBB |
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MOTOROLA
MPC826xA (HiP4) Family Hardware Specications
19
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Clock Conguration Modes
Figure 11. Internal Tick Spacing for Memory Controller Signals
NOTE
The UPM machine outputs change on the internal tick determined by the
memory controller programming; the AC specications are relative to the
internal tick. Note that SDRAM and GPCM machine outputs change on
CLKin’s rising edge.
1.3
Clock Conguration Modes
To congure the main PLL multiplication factor and the core, CPM, and 60x bus frequencies, the
MODCK[1–3] pins are sampled while HRESET is asserted. Table 14 shows the eight basic conguration
modes. Another 49 modes are available by using the conguration pin (RSTCONF) and driving four pins
on the data bus.
1.3.1
Local Bus Mode
Table 14 describes default clock modes for the MPC826xA.
Table 15 describes all possible clock congurations when using the hard reset conguration sequence.
Note that clock conguration changes only after POR is asserted. Note also that basic modes are shown in
boldface type.
Table 14. Clock Default Modes
MODCK[1–3]
Input Clock
Frequency
CPM Multiplication
Factor
CPM
Frequency
Core Multiplication
Factor
Core
Frequency
000
33 MHz
3
100 MHz
4
133 MHz
001
33 MHz
3
100 MHz
5
166 MHz
010
33 MHz
4
133 MHz
4
133 MHz
011
33 MHz
4
133 MHz
5
166 MHz
100
66 MHz
2
133 MHz
2.5
166 MHz
101
66 MHz
2
133 MHz
3
200 MHz
110
66 MHz
2.5
166 MHz
2.5
166 MHz
111
66 MHz
2.5
166 MHz
3
200 MHz
CLKin
T1
T2
T3
T4
CLKin
T1
T2
T3
T4
for 1:2.5
for 1:3.5
CLKin
T1
T2
T3
T4
for 1:2, 1:3, 1:4, 1:5, 1:6
相关PDF资料 |
PDF描述 |
|---|---|
| MPC8265AZUPIBB | 32-BIT, 300 MHz, RISC PROCESSOR, PBGA480 |
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