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参数资料
| 型号： | MPC8343CVRAGDB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA620 |
| 封装： | 29 X 29 MM, 2.46 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, BGA-620 |
| 文件页数： | 43/79页 |
| 文件大小： | 992K |
| 代理商： | MPC8343CVRAGDB |
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MPC8343EA PowerQUICC II Pro Integrated Host Processor Hardware Specifications, Rev. 10
48
Freescale Semiconductor
Package and Pin Listings
Figure 33 and Figure 34 represent the AC timings from Table 50. Note that although the specifications
generally reference the rising edge of the clock, these AC timing diagrams also apply when the falling edge
is the active edge.
Figure 33 shows the SPI timings in slave mode (external clock).
Figure 33. SPI AC Timing in Slave Mode (External Clock) Diagram
Figure 34 shows the SPI timings in master mode (internal clock).
Figure 34. SPI AC Timing in Master Mode (Internal Clock) Diagram
18 Package and Pin Listings
This section details package parameters, pin assignments, and dimensions. The MPC8343EA is available
in a plastic ball grid array (PBGA). See Section 18.1, “Package Parameters for the MPC8343EA PBGA,”
18.1
Package Parameters for the MPC8343EA PBGA
The package parameters are as provided in the following list. The package type is 29 mm
× 29 mm,
620 plastic ball grid array (PBGA).
Package outline
29 mm
× 29 mm
Interconnects
620
Pitch
1.00 mm
Module height (maximum)
2.46 mm
SPICLK (Input)
tNEIXKH
tNEIVKH
tNEKHOX
Input Signals:
SPIMOSI
(See Note)
Output Signals:
SPIMISO
(See Note)
Note: The clock edge is selectable on SPI.
SPICLK (Output)
tNIIXKH
tNIKHOX
Input Signals:
SPIMISO
(See Note)
Output Signals:
SPIMOSI
(See Note)
Note: The clock edge is selectable on SPI.
tNIIVKH
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PDF描述 |
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参数描述 |
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| MPC8343CZQADDB | 功能描述:微处理器 - MPU 8347 PBGA W/O ENC W/ PB RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
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