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参数资料
| 型号： | MPC8343EZQAGD |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 400 MHz, RISC PROCESSOR, PBGA620 |
| 封装： | 29 X 29 MM, 2.46 MM HEIGHT, 1 MM PITCH, PLASTIC, BGA-620 |
| 文件页数： | 18/84页 |
| 文件大小： | 1428K |
| 代理商： | MPC8343EZQAGD |
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MPC8343E PowerQUICC II Pro Integrated Host Processor Hardware Specifications, Rev. 12
Freescale Semiconductor
25
Ethernet: Three-Speed Ethernet, MII Management
Figure 10 shows the MII receive AC timing diagram.
Figure 10. MII Receive AC Timing Diagram
8.2.2
RGMII and RTBI AC Timing Specifications
Table 23 presents the RGMII and RTBI AC timing specifications.
Table 23. RGMII and RTBI AC Timing Specifications
At recommended operating conditions with LVDD of 2.5 V ± 5%.
Parameter/Condition
Symbol1
Min
Typ
Max
Unit
Data to clock output skew (at transmitter)
tSKRGT
–0.5
—
0.5
ns
Data to clock input skew (at receiver)2
tSKRGT
1.0
—
2.8
ns
Clock cycle duration3
tRGT
7.2
8.0
8.8
ns
Duty cycle for 1000Base-T4, 5
tRGTH/tRGT
45
50
55
%
Duty cycle for 10BASE-T and 100BASE-TX3, 5
tRGTH/tRGT
40
50
60
%
Rise time (20%–80%)
tRGTR
—
0.75
ns
Fall time (20%–80%)
tRGTF
—
0.75
ns
GTX_CLK125 reference clock period
tG12
6
—8.0
—
ns
GTX_CLK125 reference clock duty cycle
tG125H/tG125
47
—
53
%
Notes:
1. In general, the clock reference symbol for this section is based on the symbols RGT to represent RGMII and RTBI timing. For
example, the subscript of tRGT represents the TBI (T) receive (RX) clock. Also, the notation for rise (R) and fall (F) times
follows the clock symbol. For symbols representing skews, the subscript is SK followed by the clock being skewed (RGT).
2. This implies that PC board design requires clocks to be routed so that an additional trace delay of greater than 1.5 ns is added
to the associated clock signal.
3. For 10 and 100 Mbps, tRGT scales to 400 ns ± 40 ns and 40 ns ± 4 ns, respectively.
4. Duty cycle may be stretched/shrunk during speed changes or while transitioning to a received packet clock domains as long
as the minimum duty cycle is not violated and stretching occurs for no more than three tRGT of the lowest speed transitioned.
5. Duty cycle reference is LVDD/2.
6. This symbol represents the external GTX_CLK125 and does not follow the original symbol naming convention.
RX_CLK
RXD[3:0]
tMRDXKH
tMRX
tMRXH
tMRXR
tMRXF
RX_DV
RX_ER
tMRDVKH
Valid Data
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PDF描述 |
|---|---|
| MPC8250ACVVMIBX | 32-BIT, 266 MHz, RISC PROCESSOR, PBGA480 |
| MC908GR60ACFUR2 | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| MC912D60CMPVE | 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP112 |
| MC9S12DB128CPVE | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP112 |
| MC9S12DG128VFUR2 | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP80 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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