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参数资料
| 型号： | MPC8377EVRANGA |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA689 |
| 封装： | 31 X 31 MM, 2.46 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, BGA-689 |
| 文件页数： | 64/124页 |
| 文件大小： | 1462K |
| 代理商： | MPC8377EVRANGA |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页当前第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页
MPC8377E PowerQUICC II Pro Processor Hardware Specifications, Rev. 2
44
Freescale Semiconductor
Enhanced Secure Digital Host Controller (eSDHC)
Figure 26 provides the eSDHC clock input timing diagram.
Figure 26. eSDHC Clock Input Timing Diagram
Input hold times: SD_CMD, SD_DAT
x, SD_CD to
SD_CLK
tSFSIXKH
0—
ns
SD_CLK delay within device
tINT_CLK_DLY
1.5
—
ns
Output valid: SD_CLK to SD_CMD, SD_DAT
x valid
tSFSKHOV
—4
ns
Output hold: SD_CLK to SD_CMD, SD_DAT
x valid
tSFSKHOX
0—
—
SD card input setup
tISU
5—
ns
SD card input hold
tIH
5—
ns
SD card output valid
tODLY
—14
ns
SD card output hold
tOH
0—
ns
Notes:
1 The symbols used for timing specifications herein follow the pattern of t
(first three letters of functional block)(signal)(state)
(reference)(state) for inputs and t(first three letters of functional block)(reference)(state)(signal)(state) for outputs. For example, tSFSIXKH
symbolizes eSDHC full mode speed device timing (SFS) input (I) to go invalid (X) with respect to the clock reference (K) going
to high (H). Also tSFSKHOV symbolizes eSDHC full speed timing (SFS) for the clock reference (K) to go high (H), with respect
to the output (O) going valid (V) or data output valid time. Note that, in general, the clock reference symbol representation is
based on five letters representing the clock of a particular functional. For rise and fall times, the latter convention is used with
the appropriate letter: R (rise) or F (fall).
2 Measured at capacitive load of 40 pF.
3 For reference only, according to the SD card specifications.
4 Average, for reference only.
Table 41. eSDHC AC Timing Specifications for Full-Speed Mode (continued)
At recommended operating conditions OVDD = 3.3 V ± 165 mV.
Parameter
Symbol 1
Min
Max
Unit
Notes
eSDHC
tSFSCKR
External Clock
VM
tSFSCK
tSFSCKF
VM = Midpoint Voltage (OVDD/2)
operational mode
tSFSCKL
tSFSCKH
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