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参数资料
| 型号： | MPC852TVR66 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 66 MHz, RISC PROCESSOR, PBGA256 |
| 封装： | PLASTIC, BGA-256 |
| 文件页数： | 46/72页 |
| 文件大小： | 1210K |
| 代理商： | MPC852TVR66 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页当前第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页
50
MPC852T Hardware Specifications
MOTOROLA
CPM Electrical Characteristics
Figure 48. HDLC Bus Timing Diagram
14.6 Ethernet Electrical Specifications
Table 22. Ethernet Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
120
CLSN width high
40
—
ns
121
RCLK3 rise/fall time
—
15
ns
122
RCLK3 width low
40
—
ns
123
RCLK3 clock period 1
80
120
ns
124
RXD3 setup time
20
—
ns
125
RXD3 hold time
5
—
ns
126
RENA active delay (from RCLK3 rising edge of the last data bit)
10
—
ns
127
RENA width low
100
—
ns
128
TCLK3 rise/fall time
—
15
ns
129
TCLK3 width low
40
—
ns
130
TCLK3 clock period1
99
101
ns
131
TXD3 active delay (from TCLK3 rising edge)
—
50
ns
132
TXD3 inactive delay (from TCLK3 rising edge)
6.5
50
ns
133
TENA active delay (from TCLK3 rising edge)
10
50
ns
134
TENA inactive delay (from TCLK3 rising edge)
10
50
ns
TCLK3
CTS3
(Echo Input)
102
100
104
TxD3
(Output)
102
101
RTS3
(Output)
103
104
107
105
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