参数资料
型号: MPC961PACR2
厂商: IDT, Integrated Device Technology Inc
文件页数: 6/13页
文件大小: 0K
描述: IC BUFFER ZD 1:18 PLL 32-LQFP
标准包装: 2,000
类型: 零延迟缓冲器
PLL:
输入: LVPECL
输出: LVCMOS
电路数: 1
比率 - 输入:输出: 1:17
差分 - 输入:输出: 是/无
频率 - 最大: 200MHz
除法器/乘法器: 无/无
电源电压: 2.375 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 32-LQFP
供应商设备封装: 32-TQFP(7x7)
包装: 带卷 (TR)
MPC961P REVISION 5 JANUARY 8, 2013
2
2013 Integrated Device Technology, Inc.
MPC961P Data Sheet
LOW VOLTAGE ZERO DELAY BUFFER
Figure 1. MPC961P Logic Diagram
Figure 2. 32-Lead Pinout (Top View)
Table 1. Pin Configurations
Number
Name
Type
Description
PCLK, PCLK
Input
LVCMOS
PLL reference clock signal
FB_IN
Input
LVCMOS
PLL feedback signal input, connect to a QFB output
F_RANGE
Input
LVCMOS
PLL frequency range select
OE
Input
LVCMOS
Output enable/disable
Q0 – Q16
Output
LVCMOS
Clock outputs
QFB
Output
LVCMOS
PLL feedback signal output, connect to a FB_IN
GND
Supply
Ground
Negative power supply
VCCA
Supply
VCC
PLL positive power supply (analog power supply). The MPC961P requires an
external RC filter for the analog power supply pin VCCA. Please see applications
section for details.
VCC
Supply
VCC
Positive power supply for I/O and core
Table 2. Function Table
Control
Default
0
1
F_RANGE
0
PLL high frequency range. MPC961P input reference and
output clock frequency range is 100 – 200 MHz
PLL low frequency range. MPC961P input reference and
output clock frequency range is 50 – 100 MHz
OE
0
Outputs enabled
Outputs disabled (high-impedance state)
Q5
Q4
Q3
GND
Q2
Q1
Q0
VCC
Q12
Q13
Q14
GND
Q15
V
CC
Q6
Q7
Q8
GND
Q9
Q10
Q11
GN
D
PCL
K
PCL
K
F_RAN
G
E
V
CCA
OE
FB
_I
N
V
CC
25
26
27
28
29
30
31
32
15
14
13
12
11
10
9
12
3
4
5
6
78
24
23
22
21
20
19
18
17
16
MPC961P
VCC
Q16
QFB
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