参数资料
型号: MR2A08AMA35R
厂商: Everspin Technologies Inc
文件页数: 5/14页
文件大小: 0K
描述: IC MRAM 4MBIT 35NS 48BGA
标准包装: 1,500
格式 - 存储器: RAM
存储器类型: MRAM(磁阻 RAM)
存储容量: 4M (512K x 8)
速度: 35ns
接口: 并联
电源电压: 3 V ~ 3.6 V
工作温度: 0°C ~ 70°C
封装/外壳: 48-LFBGA
供应商设备封装: 48-FBGA(8x8)
包装: 带卷 (TR)
Electrical Specifications
Table 2.2 Operating Conditions
MR2A08A
Parameter
Power supply voltage  1
Write inhibit voltage
Input high voltage
Input low voltage
Temperature under bias
MR2A08A (Commercial)
MR2A08AC (Industrial)
MR2A08AM (AEC-Q100 Grade 1) 4
Symbol
V DD
V WI
V IH
V IL
T A
Min
3.0
2.5
2.2
-0.5  3
0
-40
-40
Typical
3.3
2.7
-
-
Max
3.6
3.0  1
V DD  + 0.3  2
0.8
70
85
125
Unit
V
V
V
V
°C
There is a 2 ms startup time once V DD  exceeds V DD, (min). See  Power Up and Power Down Sequencing below.
V IH (max) = V DD  + 0.3 V DC  ;  V IH (max) = V DD  + 2.0 V AC  (pulse width ≤ 10 ns) for I ≤ 20.0 mA.
  V IL (min) = -0.5 V DC  ; V IL (min) = -2.0 V AC  (pulse width ≤ 10 ns) for I ≤ 20.0 mA.
  AEC-Q100 Grade 1 temperature profile assumes 10% duty cycle at maximum temperature (2-years out of 20-year life)
3
4
Power Up and Power Down Sequencing
The MRAM is protected from write operations whenever V DD  is less than V WI . As soon as V DD  exceeds V DD (min), there is a 
startup time of 2 ms before read or write operations can start. This time allows memory power supplies to stabilize. 
The  E  and  W  control signals should track V DD  on power up to V DD - 0.2 V or V IH  (whichever is lower) and remain high 
for the startup time. In most systems, this means that these signals should be pulled up with a resistor so that signal 
remains high if the driving signal is Hi-Z during power up. Any logic that drives  E  and  W  should hold the signals high 
with a power-on reset signal for longer than the startup time. 
During power loss or brownout where V DD  goes below V WI , writes are protected and a startup time must be observed 
when power returns above V DD (min).
Figure 2.1 Power Up and Power Down Diagram
V WI
V DD
BROWNOUT or POWER LOSS
2 ms
STARTUP
2 ms
RECOVER
READ/WRITE
INHIBITED
NORMAL
OPERATION
READ/WRITE
INHIBITED
NORMAL
OPERATION
V IH
V IH
E
W
Everspin Technologies       ? 2012
5
MR2A08A Rev. 6, 8/2012
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