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参数资料
| 型号： | MSP430F5418AIPNR |
| 厂商： | TEXAS INSTRUMENTS INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 25 MHz, RISC MICROCONTROLLER, PQFP80 |
| 封装： | PLASTIC, LQFP-80 |
| 文件页数： | 90/104页 |
| 文件大小： | 1004K |
| 代理商： | MSP430F5418AIPNR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页当前第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页
P9.0/UCB2STE/UCA2CLK
P9.1/UCB2SIMO/UCB2SDA
P9.2/UCB2SOMI/UCB2SCL
P9.3/UCB2CLK/UCA2STE
P9.4/UCA2TXD/UCA2SIMO
P9.5/UCA2RXD/UCA2SOMI
P9.6
P9.7
Direction
0: Input
1: Output
P9SEL.x
1
0
P9DIR.x
P9IN.x
EN
Module X IN
1
0
Module X OUT
P9OUT.x
1
0
DV
SS
DV
CC
P9REN.x
Pad Logic
1
P9DS.x
0: Low drive
1: High drive
D
MSP430F543xA, MSP430F541xA
SLAS655B – JANUARY 2010 – REVISED OCTOBER 2010
www.ti.com
Port P9, P9.0 to P9.7, Input/Output With Schmitt Trigger
Table 57. Port P9 (P9.0 to P9.7) Pin Functions
CONTROL BITS/SIGNALS(1)
PIN NAME (P9.x)
x
FUNCTION
P9DIR.x
P9SEL.x
P9.0/UCB2STE/UCA2CLK
0
P9.0 (I/O)
I: 0; O: 1
0
UCB2STE/UCA2CLK(2) (3)
X
1
P9.1/UCB2SIMO/UCB2SDA
1
P9.1 (I/O)
I: 0; O: 1
0
UCB2SIMO/UCB2SDA(2) (4)
X
1
P9.2/UCB2SOMI/UCB2SCL
2
P9.2 (I/O)
I: 0; O: 1
0
UCB2SOMI/UCB2SCL(2) (4)
X
1
P9.3/UCB2CLK/UCA2STE
3
P9.3 (I/O)
I: 0; O: 1
0
UCB2CLK/UCA2STE(2)
X
1
P9.4/UCA2TXD/UCA2SIMO
4
P9.4 (I/O)
I: 0; O: 1
0
UCA2TXD/UCA2SIMO(2)
X
1
P9.5/UCA2RXD/UCA2SOMI
5
P9.5 (I/O)
I: 0; O: 1
0
UCA2RXD/UCA2SOMI(2)
X
1
P9.6
6
P9.6 (I/O)
I: 0; O: 1
0
P9.7
7
P9.7 (I/O)
I: 0; O: 1
0
(1)
X = Don't care
(2)
The pin direction is controlled by the USCI module.
(3)
UCA2CLK function takes precedence over UCB2STE function. If the pin is required as UCA2CLK input or output, USCI A2/B2 is forced
to 3-wire SPI mode if 4-wire SPI mode is selected.
(4)
If the I2C functionality is selected, the output drives only the logical 0 to VSS level.
86
Copyright 2010, Texas Instruments Incorporated
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PDF描述 |
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