参数资料
| 型号： | MX7705EWE+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 30/33页 |
| 文件大小： | 0K |
| 描述： | IC ADC 16BIT 2CH 16-SOIC |
| 产品培训模块： | MAX11200 ADC Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 46 |
| 位数： | 16 |
| 采样率（每秒）： | 500 |
| 数据接口： | MICROWIRE?，QSPI?，串行，SPI? |
| 转换器数目： | 1 |
| 电压电源： | 单电源 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 16-SOIC W |
| 包装： | 管件 |
| 输入数目和类型： | 2 个差分，单极 |
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MX7705
16-Bit, Low-Power, 2-Channel,
Sigma-Delta ADC
6
_______________________________________________________________________________________
TIMING CHARACTERISTICS
(VDD = 3V or 5V, GND = 0, VREF+ = 1.225V for VDD = 3V and VREF+ = 2.5V for VDD = 5V, VREF- = GND, external fCLKIN =
2.4576MHz, CLKDIV bit = 0, CREF+ to GND = 0.1F, CREF- to GND = 0.1F, TA = TMIN to TMAX, unless otherwise noted.) (Note 16)
(Figures 8, 9)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
DRDY High Time
500 /
fCLKIN
s
Reset Pulse-Width Low
100
ns
DRDY Fall to CS Fall Setup Time
t1
0ns
CS Fall to SCLK Rise Setup Time
t2
120
ns
VDD = 4.75V to 5.25V
0
80
SCLK Fall to DOUT Valid Delay
t3
VDD = 2.7V to 3.6V
0
100
ns
SCLK Pulse-Width High
t4
100
ns
SCLK Pulse-Width Low
t5
100
ns
CS Rise to SCLK Rise Hold Time
t6
0ns
VDD = 4.75V to 5.25V
60
Bus Relinquish Time After SCLK
Rising Edge
t7
VDD = 2.7V to 3.6V
100
ns
SCLK Fall to
DRDY Rise Delay
t8
100
ns
DIN to SCLK Setup Time
t9
30
ns
DIN to SCLK Hold Time
t10
20
ns
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PDF描述 |
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参数描述 |
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| MX7705EWE+T | 功能描述:模数转换器 - ADC 16-Bit 2Ch Precision ADC RoHS:否 制造商:Texas Instruments 通道数量:2 结构:Sigma-Delta 转换速率:125 SPs to 8 KSPs 分辨率:24 bit 输入类型:Differential 信噪比:107 dB 接口类型:SPI 工作电源电压:1.7 V to 3.6 V, 2.7 V to 5.25 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:VQFN-32 |
| MX7705EWE-T | 功能描述:模数转换器 - ADC RoHS:否 制造商:Texas Instruments 通道数量:2 结构:Sigma-Delta 转换速率:125 SPs to 8 KSPs 分辨率:24 bit 输入类型:Differential 信噪比:107 dB 接口类型:SPI 工作电源电压:1.7 V to 3.6 V, 2.7 V to 5.25 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:VQFN-32 |
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