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参数资料
| 型号： | NCP1571DR2 |
| 厂商： | ON Semiconductor |
| 文件页数： | 3/16页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM 8-SOIC |
| 标准包装： | 1 |
| PWM 型： | 电流/电压模式，V²? |
| 输出数： | 1 |
| 频率 - 最大： | 250kHz |
| 电源电压： | 11.4 V ~ 12.6 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | 0°C ~ 125°C |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 包装： | 剪切带 (CT) |
| 其它名称： | NCP1571DR2OSCT |
NCP1571
ELECTRICAL CHARACTERISTICS (0 ° C < T J < 125 ° C, 11.4 V < V CC < 12.6 V, C GATE(H) = C GATE(L) = 3.3 nF,
C PGDELAY = 0.01 m F, C COMP = 0.1 m F; unless otherwise specified.)
Characteristic
Test Conditions
Min
Typ
Max
Unit
Error Amplifier
V FB Bias Current
COMP Source Current
COMP Sink Current
Reference Voltage
COMP Max Voltage
COMP Min Voltage
COMP Fault Discharge Current at UVLO
COMP Fault Discharge Threshold to
V FB = 0 V
COMP = 1.5 V, V FB = 0.8 V
COMP = 1.5 V, V FB = 1.2 V
COMP = V FB
T J < 25 ° C
V FB = 0.8 V
V FB = 1.2 V
COMP = 1.2 V, V CC = 6.9 V
?
?
15
15
0.970
0.965
2.4
?
0.5
0.1
0.2
30
30
0.980
0.980
2.7
0.1
1.7
0.25
2.0
60
60
0.990
0.995
?
0.2
?
0.3
m A
m A
m A
V
V
V
V
mA
V
Reset UVLO
Open Loop Gain
Unity Gain Bandwidth
PSRR @ 1.0 kHz
Output Transconductance
Output Impedance
?
?
?
?
?
?
?
?
?
?
98
20
70
32
2.5
?
?
?
?
?
dB
kHz
dB
mmho
M W
GATE(H) and GATE(L)
Rise Time
Fall Time
GATE(H) to GATE(L) Delay
GATE(L) to GATE(H) Delay
Minimum Pulse Width
High Voltage (AC)
1.0 V < GATE(L), GATE(H) < V CC ? 2.0 V
V CC ? 2.0 V < GATE(L), GATE(H) < 1.0 V
GATE(H) < 2.0 V, GATE(L) > 2.0 V
GATE(L) < 2.0 V, GATE(H) > 2.0 V
GATE(X) = 4.0 V
Measure GATE(L) or GATE(H)
?
?
40
40
?
V CC ? 0.5
40
40
60
60
250
V CC
80
80
100
100
?
?
ns
ns
ns
ns
ns
V
0.5 nF < C GATE(H) = C GATE(L) < 10 nF
Note 2
Low Voltage (AC)
Measure GATE(L) or GATE(H)
?
0
0.5
V
0.5 nF < C GATE(H) = C GATE(L) < 10 nF
Note 2
GATE(H)/(L) Pulldown
Resistance to GND. Note 2
20
50
115
k W
Power Good
Lower Threshold, V O Rising
Lower Threshold, V O Falling
PWRGD Low Voltage
Delay Charge Current
Delay Clamp Voltage
Delay Charge Threshold
Delay Discharge Current at UVLO
T J < 25 ° C
T J < 25 ° C
I SINK = 1.0 mA, V FB = 0 V
PGDELAY = 2.0 V
?
Ramp PGDELAY, Monitor PWRGD
PGDELAY = 0.5 V, V CC = 6.9 V
0.852
0.847
0.663
0.658
?
7.0
3.45
3.1
0.5
0.882
0.882
0.685
0.685
0.15
12
4.0
3.3
2.0
0.912
0.917
0.709
0.714
0.4
18
4.3
3.5
?
V
V
V
V
V
m A
V
V
mA
2. Guaranteed by design. Not tested in production.
http://onsemi.com
3
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