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参数资料
| 型号： | P95020ZLLGI |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 电源管理 |
| 英文描述： | 2-CHANNEL POWER SUPPLY MANAGEMENT CKT, PBGA124 |
| 封装： | LLGA-124 |
| 文件页数： | 132/137页 |
| 文件大小： | 3533K |
| 代理商： | P95020ZLLGI |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页当前第132页第133页第134页第135页第136页第137页
P95020 / Preliminary Datasheet
Revision 0.7.10
94
2010 Integrated Device Technology, Inc.
11.2 CLASS_D
– TYPICAL PERFORMANCE CHARACTERISTICS
ClassD Efficiency into 4 Ohm
40
45
50
55
60
65
70
75
80
85
90
0.0
0.5
1.0
1.5
2.0
2.5
Output Power (W)
E
ff
ic
ie
n
c
y
(%
)
"ClassD Efficiency"
Figure 27
– Clss D BTL Efficiency vs Outpout Power (4 ohm speaker)
11.3 CLASS_D
– REGISTER SETTINGS
Register pair (0x8A, 0x8C) and register pair (0x8B, 0x8D) control and monitor the CLASS_D BTL Power Output Stage.
Each half-bridge can be programmed by writing 8-bit control words to these registers.
Both Registers in each pair must be programmed identically. The Base addresses are defined in Table 3 – Register
Address Global Mapping on page 20. The offset addresses are defined as Base Address in the following table.
11.3.1
CLASS_D - Control Registers:
This Register pair contains Enable, Short Circuit Threshold and Dead-Time settings. They must be set identically.
IC Address = Page-0: 138(0x8A), C Address = 0xA08A
IC Address = Page-0: 140(0x8C), C Address = 0xA08C
Bit
Bit Name
Def.
Set.
User
Type
Value
Description / Comments
[1:0]
RESERVED
01b
RW
RESERVED
[3:2]
SCTHR_CLASS_D
01b
RW
(See Table 27)
Short Circuit Threshold
[6:4]
RESERVED
000b
RW
RESERVED
7
ENABLE_CLASS_D
0b
RW
1 = Enable
0 = Disable
Master Enable
Table 27
– Peak Short Circuit Detect Level Settings for Bits [3:2]
Bit 3
Bit 2
Description
0
Short Circuit Threshold = 10% of F/S Voltage
0
1
Short Circuit Threshold = 14% of F/S Voltage
1
0
Short Circuit Threshold = 16% of F/S Voltage
1
Short Circuit Threshold = 20% of F/S Voltage
Note
– Short Circuit detect threshold is set as a percentage of full scale output voltage.
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PDF描述 |
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参数描述 |
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