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参数资料
| 型号： | PC66-222-920 |
| 厂商： | SIEMENS AG |
| 英文描述： | 3.3V 2M x 64/72-Bit 1 BANK SDRAM Module 3.3V 4M x 64/72-Bit 2 BANK SDRAM Module |
| 中文描述： | 3.3 2米x 64/72-Bit一银行内存模块3.3 4米× 64/72-Bit 2银行内存模块 |
| 文件页数： | 4/15页 |
| 文件大小： | 76K |
| 代理商： | PC66-222-920 |
HYS64(72)V4200/8220GU
SDRAM-Modules
Semiconductor Group
4
Block Diagram for 4M x 64 and 4M x 72 1 bank SDRAM DIMM modules (HYS64V4200GU)
A0-A11, BA0, BA1
VCC
VSS
D0 - D3, (D4)
C
E
2
PROM (256wordx8bit)
SA0
SA1
SA2
SA2
SCL
SCL
CS
LDQM
DQ0-DQ7
UDQM
DQ8-DQ15
D0
CS0
DQMB0
DQ(7:0)
DQMB1
DQ(15:8)
DQMB4
DQ32-DQ39
DQMB5
DQ40-DQ47
D0 - D3, (D4)
D0 - D3, (D4)
D0 - D3, (D4)
D0 - D3, (D4)
RAS, CAS, WE
CKE0
notes: 1) all resistors are 10 Ohms
2) D4 is only used in the x72 ECC version
3) DIMM may combine bytes 0 with 4, 1 with 5, 2 with 6 and 3 with 7 to obtain most advantagous
board layout to obtain minimum DQ trance length
CLK1,CLK3
10 pF
WP
SDA
SA0
SA1
47k
CS
LDQM
DQ0-DQ7
UDQM
DQ8-DQ15
D2
CS
LDQM
DQ0-DQ7
UDQM
DQ8-DQ15
D1
CS2
DQMB2
DQ(23:16)
DQMB3
DQ(31:24)
DQMB6
DQ(55:48)
DQMB7
DQ(63:56)
CS
LDQM
DQ0-DQ7
UDQM
DQ8-DQ15
D3
CS
LDQM
DQ0-DQ7
UDQM
DQ8-DQ15
D4
Vcc
CB(7:0)
Clock Wiring
4M x 64 4M x 72
CLK0 2 SDRAM+15pF 3 SDRAM+10pF
CLK1 Termination Termination
CLK2 2 SDRAM+15pF 2 SDRAM+15pF
CLK3 Termination Termination
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