参数资料
| 型号： | PCA9655EDWR2G |
| 厂商： | ON Semiconductor |
| 文件页数： | 17/20页 |
| 文件大小： | 0K |
| 描述： | IC I/O EXPANDER I2C 16B SOIC-24 |
| 标准包装： | 1 |
| 接口： | I²C 总线，SM 总线 |
| 输入/输出数： | 16 |
| 中断输出： | 是 |
| 频率 - 时钟： | 100kHz |
| 电源电压： | 1.65 V ~ 5.5 V |
| 工作温度： | -55°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 24-SOIC |
| 包装： | 标准包装 |
| 其它名称： | PCA9655EDWR2GOSDKR |
PCA9655E
http://onsemi.com
6
Table 5. AC ELECTRICAL CHARACTERISTICS VDD = 1.65 V to 5.5 V; TA = 55°C to +125°C, unless otherwise specified.
Symbol
Parameter
Standard
Mode
Fast Mode
Fast Mode +
Unit
Min
Max
Min
Max
Min
Max
fSCL
SCL Clock Frequency
0
0.1
0
0.4
0
1.0
MHz
tBUF
BusFree Time between a STOP and START
Condition
4.7
1.3
0.5
ms
tHD:STA
Hold Time (Repeated) START Condition
4.0
0.6
0.26
ms
tSU:STA
Setup Time for a Repeated START Condition
4.7
0.6
0.26
ms
tSU:STO
Setup Time for STOP Condition
4.0
0.6
0.26
ms
tHD:DAT
Data Hold Time
0
ns
tVD:ACK
Data Valid Acknowledge Time (Note 8)
0.3
3.45
0.1
0.9
0.05
0.45
ms
tVD:DAT
Data Valid Time (Note 9)
300
50
450
ns
tSU:DAT
Data Setup Time
250
100
50
ns
tLOW
LOW Period of SCL
4.7
1.3
0.5
ms
tHIGH
HIGH Period of SCL
4.0
0.6
0.26
ms
tf
300
20 + 0.1Cb
(Note 10)
300
120
ns
tr
Rise Time of SDA and SCL
1000
20 + 0.1Cb
(Note 10)
300
120
ns
tSP
Pulse Width of Spikes Suppressed by Input Filter
(Note 13)
50
ns
tV(Q)
Data Output Valid Time
(VDD = 4.5 V to 5.5 V)
(VDD = 2.3 V to 4.5 V)
(VDD = 1.65 V to 2.3 V)
200
350
550
200
350
550
200
350
550
ns
tSU(D)
Data Input Setup Time
100
ns
tH(D)
Data Input Hold Time
1
ms
tV(INT_N)
Data Valid Time
4
ms
tRST(INT_N)
Reset Delay Time
4
ms
8. tVD:ACK = time for Acknowledgment signal from SCL LOW to SDA (out) LOW.
9. tVD:DAT = minimum time for SDA data out to be valid following SCL LOW.
10.Cb = total capacitance of one bus line in pF.
11. A master device must internally provide a hold time of al least 300 ns for the SDA signal (refer to VIL of the SCL signal) in order to bridge
the undefined region SCL’s falling edge.
12.The maximum tffor the SDA and SCL bus lines is specified at 300 ns. The maximum fall time for the SDA output stage tfis specified at 250 ns.
This allows series protection resistors to be connected between the SDA and the SCL pins and the SDA/SCL bus lines without exceeding
the maximum specified tf.
13.Input filters on the SDA and SCL inputs suppress noise spikes less than 50 ns.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| PCA9663B,118 | 功能描述:接口-I/O扩展器 7VIN 3.3VOUT 100KHz RoHS:否 制造商:NXP Semiconductors 逻辑系列: 输入/输出端数量: 最大工作频率:100 kHz 工作电源电压:1.65 V to 5.5 V 工作温度范围:- 40 C to + 85 C 安装风格:SMD/SMT 封装 / 箱体:HVQFN-16 封装:Reel |
| PCA9663B118 | 制造商:NXP 功能描述: 制造商:NXP Semiconductors 功能描述: |
| PCA9665APW,118 | 功能描述:I2C 接口集成电路 Fm+ parallel bus I2C bus controller RoHS:否 制造商:NXP Semiconductors 电源电压-最大:5.5 V 电源电压-最小:2.3 V 最大工作频率:400 KHz 最大工作温度:+ 85 C 封装 / 箱体:TSSOP-16 |
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