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参数资料
| 型号： | PEF20534 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | DMA Supported Serial Communication Controller with 4 Channels |
| 中文描述： | DMA的支持串行通信控制器，4通道 |
| 文件页数： | 298/439页 |
| 文件大小： | 4985K |
| 代理商： | PEF20534 |
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PEB 20534
PEF 20534
Detailed Register Description
Data Sheet
298
2000-05-30
STOP
Stop Bit number
This bit selects the number of stop bits per ASYNC character:
STOP=
’
0
’
1 stop bit per character.
STOP=
’
1
’
2 stop bits per character.
(async mode)
SLOAD
Enable SYNC Character Load
In BISYNC mode, SYNC characters might be filtered out or stored to the
SCC receive FIFO:
SLOAD=
’
0
’
SYNC characters are filtered out and not stored in the
receive FIFO.
SLOAD=
’
1
’
All received characters including SYNC characters are
stored in the receive FIFO.
(bisync mode)
PAR(1..0)
Parity Format
This bit field selects the parity generation/checking mode:
PAR =
’
00
’
SPACE (
’
0
’
), a constant
’
0
’
is inserted as parity bit.
PAR =
’
01
’
Odd parity.
PAR =
’
10
’
Even parity.
PAR =
’
11
’
MARK (
’
1
’
), a constant
’
1
’
is inserted as parity bit.
The received parity bit is stored in the SCC receive FIFO depending on
the selected character format:
as leading bit immediately preceding the data bits if character length
is 5, 6 or 7 bits and bit
’
DPS
’
in register CCR2 is cleared (
’
0
’
).
as LSB of the status byte belonging to the character if character length
is 8 bits and the corresponding receive FIFO data format is selected
(RFDF =
’
1
’
).
A parity error is indicated in the MSB of the status byte belonging to each
character if enabled. In addition, a parity error interrupt can be
generated.
(async/bisync modes)
PARE
Parity Enable
PARE=
’
0
’
PARE=
’
1
’
(async/bisync modes)
Parity generation/checking is disabled.
Parity generation/checking is enabled.
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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