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参数资料
| 型号： | PEF80902 |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 4B3T Second Gen. Modular ISDN NT(Ordinary) |
| 中文描述： | 4B3T二将军模块化综合业务数字网新台币（普通） |
| 文件页数： | 21/83页 |
| 文件大小： | 1168K |
| 代理商： | PEF80902 |
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PEF 80902
Functional Description
Data Sheet
13
2001-11-12
2
Functional Description
2.1
Reset Generation
External Reset Input
At the RST input an external reset can be applied forcing the T-SMINT O in the reset
state. This external reset signal is additionally fed to the RSTO output.
Reset Ouput
If VDDDET is active, then the deactivation of a reset output on RSTO is delayed by
t
DEACT
(see
Table 28
).
Reset Generation
The T-SMINT O has an on-chip reset generator based on a Power-On Reset (POR) and
Under Voltage Detection (UVD) circuit (see
Table 28
). The POR/UVD requires no
external components.
The POR/UVD circuit can be disabled via pin VDDDET.
The requirements on V
DD
ramp-up during power-on reset are described in
Chapter 4.6.3
.
Clocks and Data Lines During Reset
During reset the data clock (DCL) and the frame synchronization (FSC) keep running.
During reset DD and DU are high; with the exception of:
The output C/I code from the U-Transceiver on DD is
’
DR
’
= 0000
The output C/I code from the S-Transceiver on DU is
’
TIM
’
= 0000.
相关PDF资料 |
PDF描述 |
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参数描述 |
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