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参数资料
| 型号： | PIC16C65A-04E/L |
| 厂商： | Microchip Technology |
| 文件页数： | 81/126页 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 4KX14 PWM 44PLCC |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 27 |
| 系列： | PIC® 16C |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 4MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 33 |
| 程序存储器容量： | 7KB（4K x 14） |
| 程序存储器类型： | OTP |
| RAM 容量： | 192 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 6 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 44-LCC（J 形引线） |
| 包装： | 管件 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页当前第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页
58
AT90S/LS4433
1042H–AVR–04/03
Bit 4 – FE: Framing Error
This bit is set if a Framing Error condition is detected, i.e., when the stop bit of an incom-
ing character is zero.
The FE bit is cleared when the stop bit of received data is one.
Bit 3 – OR: OverRun
This bit is set if an OverRun condition is detected, i.e., when a character already present
in the UDR Register is not read before the next character has been shifted into the
Receiver Shift Register. The OR bit is buffered, which means that it will be set once the
valid data still in UDRE is read.
The OR bit is cleared (zero) when data is received and transferred to UDR.
Bits 2..1 – Res: Reserved Bits
These bits are reserved bits in the AT90S4433 and will always read as zero.
Bit 0 – MPCM: Multi-processor Communication Mode
This bit is used to enter Multi-processor Communication mode. The bit is set when the
slave MCU waits for an address byte to be received. When the MCU has been
addressed, the MCU switches off the MPCM bit and starts data reception.
For a detailed description, see “Multi-processor Communication Mode”.
UART Control and Status
Register B – UCSRB
Bit 7 – RXCIE: RX Complete Interrupt Enable
When this bit is set (one), a setting of the RXC bit in UCSRA will cause the Receive
Complete Interrupt routine to be executed, provided that global interrupts are enabled.
Bit 6 – TXCIE: TX Complete Interrupt Enable
When this bit is set (one), a setting of the TXC bit in UCSRA will cause the Transmit
Complete Interrupt routine to be executed, provided that global interrupts are enabled.
Bit 5 – UDRIE: UART Data Register Empty Interrupt Enable
When this bit is set (one), a setting of the UDRE bit in UCSRA will cause the UART Data
Register Empty Interrupt routine to be executed, provided that global interrupts are
enabled.
Bit 4 – RXEN: Receiver Enable
This bit enables the UART Receiver when set (one). When the Receiver is disabled, the
RXC, OR, and FE status flags cannot become set. If these flags are set, turning off
RXEN does not cause them to be cleared.
Bit
7654
321
0
$0A ($2A)
RXCIE
TXCIE
UDRIE
RXEN
TXEN
CHR9
RXB8
TXB8
UCSRB
Read/Write
R/W
R
W
Initial Value
0000
001
0
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PDF描述 |
|---|---|
| PIC16C64AT-20/PT | IC MCU OTP 2KX14 PWM 44TQFP |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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