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参数资料
| 型号： | PIC16C715T-04/SO |
| 厂商： | Microchip Technology |
| 文件页数： | 48/177页 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 2KX14 A/D 18SOIC |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 1,100 |
| 系列： | PIC® 16C |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 4MHz |
| 外围设备： | 欠压检测/复位，POR，WDT |
| 输入/输出数： | 13 |
| 程序存储器容量： | 3.5KB（2K x 14） |
| 程序存储器类型： | OTP |
| RAM 容量： | 128 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 数据转换器： | A/D 4x8b |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 18-SOIC（0.295"，7.50mm 宽） |
| 包装： | 带卷 (TR) |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页当前第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页
141
7593L–AVR–09/12
AT90USB64/128
15.10.7
TCNT1H and TCNT1L – Timer/Counter1
15.10.8
TCNT3H and TCNT3L – Timer/Counter3
The two Timer/Counter I/O locations (TCNTnH and TCNTnL, combined TCNTn) give direct
access, both for read and for write operations, to the Timer/Counter unit 16-bit counter. To
ensure that both the high and low bytes are read and written simultaneously when the CPU
accesses these registers, the access is performed using an 8-bit temporary High Byte Register
(TEMP). This temporary register is shared by all the other 16-bit registers. See “Accessing 16-bit
Modifying the counter (TCNTn) while the counter is running introduces a risk of missing a com-
pare match between TCNTn and one of the OCRnx Registers.
Writing to the TCNTn Register blocks (removes) the compare match on the following timer clock
for all compare units.
15.10.9
OCR1AH and OCR1AL – Output Compare Register 1 A
15.10.10 OCR1BH and OCR1BL – Output Compare Register 1 B
15.10.11 OCR1CH and OCR1CL – Output Compare Register 1 C
Bit
7
65
43
21
0
TCNT1[15:8]
TCNT1H
TCNT1[7:0]
TCNT1L
Read/write
R/W
Initial value
00
Bit
7
65
43
21
0
TCNT3[15:8]
TCNT3H
TCNT3[7:0]
TCNT3L
Read/write
R/W
Initial value
00
Bit
7
65
43
21
0
OCR1A[15:8]
OCR1AH
OCR1A[7:0]
OCR1AL
Read/write
R/W
Initial value
00
Bit
7
65
43
21
0
OCR1B[15:8]
OCR1BH
OCR1B[7:0]
OCR1BL
Read/write
R/W
Initial value
00
Bit
7
65
43
21
0
OCR1C[15:8]
OCR1CH
OCR1C[7:0]
OCR1CL
Read/write
R/W
Initial value
00
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PDF描述 |
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参数描述 |
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