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参数资料
| 型号： | PIC16F76-I/SS |
| 厂商： | Microchip Technology |
| 文件页数： | 23/104页 |
| 文件大小： | 0K |
| 描述： | IC MCU FLASH 8KX14 A/D 28SSOP |
| 产品培训模块： | Asynchronous Stimulus 8-bit PIC® Microcontroller Portfolio |
| 标准包装： | 47 |
| 系列： | PIC® 16F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 22 |
| 程序存储器容量： | 14KB（8K x 14） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 368 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 5.5 V |
| 数据转换器： | A/D 5x8b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 28-SSOP（0.209"，5.30mm 宽） |
| 包装： | 管件 |
| 产品目录页面： | 641 (CN2011-ZH PDF) |
| 配用： | AC164307-ND - MODULE SKT FOR PM3 28SSOP |
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PIC18F45J10 FAMILY
DS39682E-page 172
2009 Microchip Technology Inc.
16.4.4.5
Clock Synchronization and
the CKP bit
When the CKP bit is cleared, the SCLx output is forced
to ‘0’. However, clearing the CKP bit will not assert the
SCLx output low until the SCLx output is already sam-
pled low. Therefore, the CKP bit will not assert the
SCLx line until an external I2C master device has
already asserted the SCLx line. The SCLx output will
remain low until the CKP bit is set and all other
devices on the I2C bus have deasserted SCLx. This
ensures that a write to the CKP bit will not violate the
minimum high time requirement for SCLx (see
FIGURE 16-12:
CLOCK SYNCHRONIZATION TIMING
SDAx
SCLx
DX – 1
DX
WR
Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4
SSPxCON
CKP
Master Device
Deasserts Clock
Master Device
Asserts Clock
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参数描述 |
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