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参数资料
型号： PIC16F877A-I/LG
厂商： Microchip Technology
文件页数： 145/234页
文件大小： 0K
描述： IC MCU FLASH 8KX14 W/AD 44PLCC
标准包装： 27
系列： PIC® 16F
核心处理器： PIC
芯体尺寸： 8-位
速度： 20MHz
连通性： I²C，SPI，UART/USART
外围设备： 欠压检测/复位，POR，PWM，WDT
输入/输出数： 33
程序存储器容量： 14KB（8K x 14）
程序存储器类型： 闪存
EEPROM 大小： 256 x 8
RAM 容量： 368 x 8
电压 - 电源 (Vcc/Vdd)： 4 V ~ 5.5 V
数据转换器： A/D 8x10b
振荡器型： 外部
工作温度： -40°C ~ 85°C
封装/外壳： 44-LCC（J 形引线）
包装： 管件
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2008 Microchip Technology Inc.
DS39626E-page 227
PIC18F2525/2620/4525/4620
The value in the ADRESH:ADRESL registers is not
modified for a Power-on Reset. The ADRESH:ADRESL
registers will contain unknown data after a Power-on
Reset.
After the A/D module has been configured as desired,
the selected channel must be acquired before the
conversion is started. The analog input channels must
have their corresponding TRIS bits selected as an
input. To determine acquisition time, see Section 19.1
“A/D Acquisition Requirements”. After this acquisi-
tion time has elapsed, the A/D conversion can be
started. An acquisition time can be programmed to
occur between setting the GO/DONE bit and the actual
start of the conversion.
The following steps should be followed to perform an A/D
conversion:
1.
Configure the A/D module:
Configure analog pins, voltage reference and
digital I/O (ADCON1)
Select A/D input channel (ADCON0)
Select A/D acquisition time (ADCON2)
Select A/D conversion clock (ADCON2)
Turn on A/D module (ADCON0)
2.
Configure A/D interrupt (if desired):
Clear ADIF bit
Set ADIE bit
Set GIE bit
3.
Wait the required acquisition time (if required).
4.
Start conversion:
Set GO/DONE bit (ADCON0 register)
5.
Wait for A/D conversion to complete, by either:
Polling for the GO/DONE bit to be cleared
OR
Waiting for the A/D interrupt
6.
Read A/D Result registers (ADRESH:ADRESL);
clear bit ADIF, if required.
7.
For next conversion, go to step 1 or step 2, as
required. The A/D conversion time per bit is
defined as TAD. A minimum wait of 2 TAD is
required before the next acquisition starts.
FIGURE 19-2:
A/D TRANSFER FUNCTION
FIGURE 19-3:
ANALOG INPUT MODEL
Dig
ita
lCo
d
e
Ou
tp
u
t
3FEh
003h
002h
001h
000h
0.5
LS
B
1
L
S
B
1.5
LS
B
2
L
S
B
2.5
LS
B
1
022
LS
B
10
22.5
LS
B
3
L
S
B
Analog Input Voltage
3FFh
1
023
LS
B
10
23.5
LS
B
VAIN
CPIN
Rs
ANx
5 pF
VT = 0.6V
ILEAKAGE
RIC
≤ 1k
Sampling
Switch
SS
RSS
CHOLD = 25 pF
VSS
VDD
±100 nA
Legend: CPIN
VT
ILEAKAGE
RIC
SS
CHOLD
= Input Capacitance
= Threshold Voltage
= Leakage Current at the pin due to
= Interconnect Resistance
= Sampling Switch
= Sample/Hold Capacitance (from DAC)
various junctions
= Sampling Switch Resistance
RSS
VDD
6V
Sampling Switch
5V
4V
3V
2V
12
3
4
(k
Ω)
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