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参数资料
型号： PIC16LC781T-I/SS
厂商： Microchip Technology
文件页数： 37/186页
文件大小： 0K
描述： IC MCU OTP 1KX14 A/D D/A 20SSOP
产品培训模块： Asynchronous Stimulus
标准包装： 1,600
系列： PIC® 16C
核心处理器： PIC
芯体尺寸： 8-位
速度： 20MHz
外围设备： 欠压检测/复位，POR，PWM，WDT
输入/输出数： 13
程序存储器容量： 1.75KB（1K x 14）
程序存储器类型： OTP
RAM 容量： 128 x 8
电压 - 电源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
数据转换器： A/D 8x8b; D/A 1x8b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 20-SSOP（0.209"，5.30mm 宽）
包装： 带卷 (TR)
其它名称： PIC16LC781TI/SS
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页当前第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页
2001 Microchip Technology Inc.
Preliminary
DS41171A-page 129
PIC16C781/782
14.9.2
TMR0 INTERRUPT
An overflow (FFh
→ 00h) in the TMR0 register sets the
flag bit, T0IF (INTCON<2>). The interrupt can be
enabled/disabled by setting/clearing enable bit, T0IE
(INTCON<5>) (Section 2.5).
14.9.3
PORTB INTERRUPT-ON-CHANGE
(IOCB)
An input change on PORTB<7:0> sets flag bit RBIF
(INTCON<0>). The PORTB pin(s) which can individu-
ally generate interrupt are selectable in the IOCB regis-
ter. The interrupt can be enabled/disabled by setting/
clearing enable bit RBIE (INTCON<4>) (Section 2.5).
PORTB must be configured as a digital input.
14.10 Context Saving During Interrupts
During an interrupt, only the PC is saved on the stack.
At minimum, W and STATUS should be saved to pre-
serve the context for the interrupted program. All regis-
ters that may be corrupted by the Interrupt Service
Routine (ISR), such as PCLATH or FSR, should be
saved.
Example 14-1 stores and restores the STATUS, W and
PCLATH registers. The register, W_TEMP, is defined in
Common RAM, the last 16 bytes of each bank that may
be accessed from any bank. The STATUS_TEMP and
PCLATH_TEMP are defined in bank 0.
The example:
a)
Stores the W register.
b)
Stores the STATUS register in bank 0.
c)
Stores the PCLATH register in bank 0.
d)
Executes the ISR code.
e)
Restores the PCLATH register.
f)
Restores the STATUS register.
g)
Restores W.
EXAMPLE 14-1:
SAVING STATUS, W, AND
PCLATH REGISTERS
#define
W_TEMP
0x70
#define
STATUS_TEMP
0x71
#define
PCLATH_TEMP
0x72
org
0x04
; Int Vector
MOVWF
W_TEMP
; Save W
MOVF
STATUS,w
MOVWF
STATUS_TEMP
; save STATUS
MOVF
PCLATH,w
MOVWF
PCLATH_TEMP
; save PCLATH
:
(Interrupt Service Routine)
:
MOVF
PCLATH_TEMP,w
MOVWF
PCLATH
MOVF
STATUS_TEMP,w
MOVWF
STATUS
SWAPF
W_TEMP,f
; swapf loads W
SWAPF
W_TEMP,w
; w/o affect STATUS
RETFIE
14.11 Watchdog Timer (WDT)
The Watchdog Timer uses a free running, on-chip RC
oscillator, which does not require any external compo-
nents. This oscillator is independent from the processor
clock. The WDT runs even if the main clock of the
device has been stopped (for example, by execution of
a SLEEP instruction).
During normal operation, a WDT time-out generates a
device RESET (Watchdog Timer Reset). If the device is
in SLEEP mode, a WDT time-out causes the device to
wake-up and continue with normal operation (Watch-
dog Timer Wake-up). The TO bit in the STATUS regis-
ter is cleared upon a Watchdog Timer time-out.
The WDT can be permanently enabled by program-
ming the configuration bit WDTE, or by software via the
WDTON bit in the Power Control register (PCON:
8EH). See Section 14.8 and Section 14.1.
WDT time-out period values may be found in the Elec-
trical Specifications. Values for the WDT prescaler may
be assigned using the OPTION_REG register.
Note:
The
W_TEMP,
STATUS_TEMP
and
PCLATH_TEMP are defined in the com-
mon RAM area (70h - 7Fh) to avoid regis-
ter bank switching during context save and
restore.
Note 1: The CLRWDT and SLEEP instructions
clear the WDT and the postscaler, if
assigned to the WDT.
2: When a CLRWDT instruction is executed
and the prescaler is assigned to the WDT,
the prescaler count is cleared, but the
prescaler assignment is not changed.
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