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参数资料
型号： PIC16LF1783-E/ML
厂商： Microchip Technology
文件页数： 357/382页
文件大小： 0K
描述： IC MCU 8BIT 7KB FLASH 28-QFN
标准包装： 61
系列： PIC® XLP™ 16F
核心处理器： PIC
芯体尺寸： 8-位
速度： 32MHz
连通性： I²C，LIN，SPI，UART/USART
外围设备： 断电检测/复位，POR，PSMC，PWM，WDT
输入/输出数： 24
程序存储器容量： 7KB（4K x 14）
程序存储器类型： 闪存
EEPROM 大小： 256 x 8
RAM 容量： 512 x 8
电压 - 电源 (Vcc/Vdd)： 1.8 V ~ 3.6 V
数据转换器： A/D 11x12b，D/A 1x8b
振荡器型： 内部
工作温度： -40°C ~ 125°C
封装/外壳： 28-VQFN 裸露焊盘
包装： 管件
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PIC16(L)F1782/3
DS41579C-page 76
Preliminary
2011-2012 Microchip Technology Inc.
7.5
Register Definition: Reference Clock Control
REGISTER 7-1:
CLKRCON: REFERENCE CLOCK CONTROL REGISTER
R/W-0/0
R/W-1/1
R/W-0/0
CLKREN
CLKROE
CLKRSLR
CLKRDC<1:0>
CLKRDIV<2:0>
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
u = Bit is unchanged
x = Bit is unknown
-n/n = Value at POR and BOR/Value at all other Resets
‘1’ = Bit is set
‘0’ = Bit is cleared
bit 7
CLKREN: Reference Clock Module Enable bit
1 = Reference clock module is enabled
0 = Reference clock module is disabled
bit 6
CLKROE: Reference Clock Output Enable bit
1 = Reference clock output is enabled on CLKR pin
0 = Reference clock output disabled on CLKR pin
bit 5
CLKRSLR: Reference Clock Slew Rate Control Limiting Enable bit
1 = Slew rate limiting is enabled
0 = Slew rate limiting is disabled
bit 4-3
CLKRDC<1:0>: Reference Clock Duty Cycle bits
11 = Clock outputs duty cycle of 75%
10 = Clock outputs duty cycle of 50%
01 = Clock outputs duty cycle of 25%
00 = Clock outputs duty cycle of 0%
bit 2-0
CLKRDIV<2:0> Reference Clock Divider bits
111 = Base clock value divided by 128
110 = Base clock value divided by 64
101 = Base clock value divided by 32
100 = Base clock value divided by 16
011 = Base clock value divided by 8
010 = Base clock value divided by 4
001 = Base clock value divided by 2(1)
000 = Base clock value(2)
Note 1: In this mode, the 25% and 75% duty cycle accuracy will be dependent on the source clock duty cycle.
2: In this mode, the duty cycle will always be equal to the source clock duty cycle, unless a duty cycle of 0%
is selected.
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