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参数资料
型号： PIC18C242-I/SO
元件分类： 微控制器/微处理器
英文描述： 8-BIT, OTPROM, 40 MHz, RISC MICROCONTROLLER, PDSO28
封装： 0.300 INCH, PLASTIC, MS-013, SO-28
文件页数： 136/305页
文件大小： 5272K
代理商： PIC18C242-I/SO
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页当前第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页第239页第240页第241页第242页第243页第244页第245页第246页第247页第248页第249页第250页第251页第252页第253页第254页第255页第256页第257页第258页第259页第260页第261页第262页第263页第264页第265页第266页第267页第268页第269页第270页第271页第272页第273页第274页第275页第276页第277页第278页第279页第280页第281页第282页第283页第284页第285页第286页第287页第288页第289页第290页第291页第292页第293页第294页第295页第296页第297页第298页第299页第300页第301页第302页第303页第304页第305页
PIC18CXX2
DS39026C-page 218
2001 Microchip Technology Inc.
RETFIE
Return from Interrupt
Syntax:
[ label ]
RETFIE [s]
Operands:
s
∈ [0,1]
Operation:
(TOS)
→ PC,
1
→ GIE/GIEH or PEIE/GIEL,
if s = 1
(WS)
→ WREG,
(STATUSS)
→ STATUS,
(BSRS)
→ BSR,
PCLATU, PCLATH are unchanged.
Status Affected:
GIE/GIEH,PEIE/GIEL.
Encoding:
0000
0001
000s
Description:
Return from Interrupt. Stack is
popped and Top-of-Stack (TOS) is
loaded into the PC. Interrupts are
enabled by setting either the high
or low priority global interrupt
enable bit. If ‘s’ = 1, the contents of
the shadow registers WS,
STATUSS and BSRS are loaded
into their corresponding registers,
WREG, STATUS and BSR. If
‘s’ = 0, no update of these registers
occurs (default).
Words:
1
Cycles:
2
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
No
operation
No
operation
pop PC from
stack
Set GIEH or
GIEL
No
operation
No
operation
No
operation
No
operation
Example:
RETFIE
1
After Interrupt
PC
=
TOS
W=
WS
BSR
=
BSRS
STATUS
=
STATUSS
GIE/GIEH, PEIE/GIEL=
1
RETLW
Return Literal to WREG
Syntax:
[ label ]
RETLW k
Operands:
0
≤ k ≤ 255
Operation:
k
→ WREG,
(TOS)
→ PC,
PCLATU, PCLATH are unchanged
Status Affected:
None
Encoding:
0000
1100
kkkk
Description:
WREG is loaded with the eight-bit
literal 'k'. The program counter is
loaded from the top of the stack
(the return address). The high
address latch (PCLATH) remains
unchanged.
Words:
1
Cycles:
2
Q Cycle Activity:
Q1
Q2
Q3
Q4
Decode
Read
literal ’k’
Process
Data
pop PC from
stack, Write
to WREG
No
operation
No
operation
No
operation
No
operation
Example:
CALL TABLE
; WREG contains table
; offset value
; WREG now has
; table value
:
TABLE
ADDWF PCL
; WREG = offset
RETLW k0
; Begin table
RETLW k1
;
:
RETLW kn
; End of table
Before Instruction
WREG
=
0x07
After Instruction
WREG
=
value of kn
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