参数资料
型号: PIC18F2520-E/SP
厂商: Microchip Technology
文件页数: 84/151页
文件大小: 0K
描述: IC MCU FLASH 16KX16 28-DIP
产品培训模块: Asynchronous Stimulus
标准包装: 15
系列: PIC® 18F
核心处理器: PIC
芯体尺寸: 8-位
速度: 25MHz
连通性: I²C,SPI,UART/USART
外围设备: 欠压检测/复位,HLVD,POR,PWM,WDT
输入/输出数: 25
程序存储器容量: 32KB(16K x 16)
程序存储器类型: 闪存
EEPROM 大小: 256 x 8
RAM 容量: 1.5K x 8
电压 - 电源 (Vcc/Vdd): 4.2 V ~ 5.5 V
数据转换器: A/D 10x10b
振荡器型: 内部
工作温度: -40°C ~ 125°C
封装/外壳: 28-DIP(0.300",7.62mm)
包装: 管件
配用: MCP3909RD-3PH1-ND - REF DESIGN MCP3909 3PH ENGY MTR
DVA18XP280-ND - DEVICE ADAPTER 18F2220 PDIP 28LD
2011-2012 Microchip Technology Inc.
Preliminary
DS41579C-page 351
PIC16(L)F1782/3
TABLE 29-3:
PIC16(L)F1782/3 INSTRUCTION SET
Mnemonic,
Operands
Description
Cycles
14-Bit Opcode
Status
Affected
Notes
MSb
LSb
BYTE-ORIENTED FILE REGISTER OPERATIONS
ADDWF
ADDWFC
ANDWF
ASRF
LSLF
LSRF
CLRF
CLRW
COMF
DECF
INCF
IORWF
MOVF
MOVWF
RLF
RRF
SUBWF
SUBWFB
SWAPF
XORWF
f, d
f
f, d
f
f, d
Add W and f
Add with Carry W and f
AND W with f
Arithmetic Right Shift
Logical Left Shift
Logical Right Shift
Clear f
Clear W
Complement f
Decrement f
Increment f
Inclusive OR W with f
Move f
Move W to f
Rotate Left f through Carry
Rotate Right f through Carry
Subtract W from f
Subtract with Borrow W from f
Swap nibbles in f
Exclusive OR W with f
1
00
11
00
11
00
11
00
0111
1101
0101
0111
0101
0110
0001
1001
0011
1010
0100
1000
0000
1101
1100
0010
1011
1110
0110
dfff
lfff
0000
dfff
1fff
dfff
ffff
00xx
ffff
C, DC, Z
Z
C, Z
Z
C
C, DC, Z
Z
2
BYTE ORIENTED SKIP OPERATIONS
DECFSZ
INCFSZ
f, d
Decrement f, Skip if 0
Increment f, Skip if 0
1(2)
00
1011
1111
dfff
ffff
1, 2
BIT-ORIENTED FILE REGISTER OPERATIONS
BCF
BSF
f, b
Bit Clear f
Bit Set f
1
01
00bb
01bb
bfff
ffff
2
BIT-ORIENTED SKIP OPERATIONS
BTFSC
BTFSS
f, b
Bit Test f, Skip if Clear
Bit Test f, Skip if Set
1 (2)
01
10bb
11bb
bfff
ffff
1, 2
LITERAL OPERATIONS
ADDLW
ANDLW
IORLW
MOVLB
MOVLP
MOVLW
SUBLW
XORLW
k
Add literal and W
AND literal with W
Inclusive OR literal with W
Move literal to BSR
Move literal to PCLATH
Move literal to W
Subtract W from literal
Exclusive OR literal with W
1
11
00
11
1110
1001
1000
0000
0001
0000
1100
1010
kkkk
001k
1kkk
kkkk
C, DC, Z
Z
C, DC, Z
Z
Note 1:
If the Program Counter (PC) is modified, or a conditional test is true, the instruction requires two cycles. The second
cycle is executed as a NOP.
2:
If this instruction addresses an INDF register and the MSb of the corresponding FSR is set, this instruction will require
one additional instruction cycle.
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