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参数资料
| 型号： | PIC18F45J50T-I/PT |
| 厂商： | Microchip Technology |
| 文件页数： | 94/164页 |
| 文件大小： | 0K |
| 描述： | IC PIC MCU FLASH 32KB 44-TQFP |
| 产品培训模块： | PIC18 J Series MCU Overview |
| 标准包装： | 1,200 |
| 系列： | PIC® XLP™ 18F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 48MHz |
| 连通性： | I²C，SPI，UART/USART，USB |
| 外围设备： | 欠压检测/复位，DMA，POR，PWM，WDT |
| 输入/输出数： | 34 |
| 程序存储器容量： | 32KB（16K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 3.8K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.15 V ~ 3.6 V |
| 数据转换器： | A/D 13x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-TQFP |
| 包装： | 带卷 (TR) |
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PIC18F46J50 FAMILY
DS39931D-page 40
2011 Microchip Technology Inc.
3.3
Oscillator Settings for USB
When the PIC18F46J50 family devices are used for
USB connectivity, a 6 MHz or 48 MHz clock must be
provided to the USB module for operation in either
Low-Speed or Full-Speed modes, respectively. This
may require some forethought in selecting an oscillator
frequency and programming the device.
The full range of possible oscillator configurations
compatible with USB operation is shown in Table 3-5.
3.3.1
LOW-SPEED OPERATION
The USB clock for Low-Speed mode is derived from the
primary oscillator or from the 96 MHz PLL. In order to
operate the USB module in Low-Speed mode, a 6 MHz
clock must be provided to the USB module. Due to the
way the clock dividers have been implemented in the
PIC18F46J50 family, the microcontroller core must run
at 24 MHz in order for the USB module to get the 6 MHz
clock needed for low-speed USB operation. Several
clocking schemes could be used to meet these two
possible combinations which can be used for
low-speed USB operation.
TABLE 3-4:
CLOCK FOR LOW-SPEED USB
REGISTER 3-1:
OSCTUNE: OSCILLATOR TUNING REGISTER (ACCESS F9Bh)
R/W-0
INTSRC
PLLEN
TUN5
TUN4
TUN3
TUN2
TUN1
TUN0
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
INTSRC:
Internal Oscillator Low-Frequency Source Select bit
1
= 31.25 kHz device clock derived from 8 MHz INTOSC source (divide-by-256 enabled)
0
= 31 kHz device clock derived directly from INTRC internal oscillator
bit 6
PLLEN:
Frequency Multiplier Enable bit
1
= 96 MHz PLL is enabled
0
= 96 MHz PLL is disabled
bit 5-0
TUN<5:0>:
Frequency Tuning bits
011111
= Maximum frequency
011110
000001
000000
= Center frequency; oscillator module is running at the calibrated frequency
111111
100000
= Minimum frequency
Clock
Input
CPU
Clock
CPDIV<1:0>
USB Clock
48
24
‘10’
48/8 = 6 MHz
24
‘11’
24/4 = 6 MHz
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参数描述 |
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