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参数资料
| 型号： | PIC18F45K20-I/ML |
| 厂商： | Microchip Technology |
| 文件页数： | 20/42页 |
| 文件大小： | 0K |
| 描述： | IC PIC MCU FLASH 16KX16 44QFN |
| 产品培训模块： | PIC18 K-Series 8-bit PIC® Microcontroller Portfolio |
| 标准包装： | 45 |
| 系列： | PIC® XLP™ 18F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 64MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，HLVD，POR，PWM，WDT |
| 输入/输出数： | 35 |
| 程序存储器容量： | 32KB（16K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 256 x 8 |
| RAM 容量： | 1.5K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 14x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-VQFN 裸露焊盘 |
| 包装： | 管件 |
| 产品目录页面： | 656 (CN2011-ZH PDF) |
| 配用： | AC164112-ND - VOLTAGE LIMITER MPLAB ICD2 VPP DM164124-ND - KIT STARTER FOR PIC18F4XK20 AC164322-ND - MODULE SOCKET MPLAB PM3 28/44QFN |
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2009 Microchip Technology Inc.
Advance Information
DS41297F-page 27
PIC18F2XK20/4XK20
FIGURE 4-4:
SHIFT OUT DATA HOLDING REGISTER TIMING DIAGRAM (0010)
FIGURE 4-5:
HIGH-IMPEDANCE DELAY
4.5
Verify Data EEPROM
A data EEPROM address may be read via a sequence
of core instructions (4-bit command, ‘0000’) and then
output on PGD via the 4-bit command, ‘0010’ (TABLAT
register).
The
result
may
then
be
immediately
compared to the appropriate data in the programmer’s
memory for verification. Refer to Section 4.4 “Read
Data EEPROM Memory” for implementation details of
reading data EEPROM.
4.6
Blank Check
The term “Blank Check” means to verify that the device
has no programmed memory cells. All memories must
be verified: code memory, data EEPROM, ID locations
and Configuration bits. The device ID registers
(3FFFFEh:3FFFFFh) should be ignored.
A “blank” or “erased” memory cell will read as a ‘1’.
Therefore, Blank Checking a device merely means to
verify that all bytes read as FFh except the Configura-
tion bits. Unused (reserved) Configuration bits will read
‘0’ (programmed). Refer to Table 5-1 for blank configu-
ration expect data for the various PIC18F2XK20/
4XK20 devices.
Given that Blank Checking is merely code and data
EEPROM verification with FFh expect data, refer to
for implementation details.
FIGURE 4-6:
BLANK CHECK FLOW
12
3
4
PGC
P5
PGD
PGD = Input
Shift Data Out
P6
PGD = Output
56
7
8
1
23
4
P5A
910
11
13
15
16
14
12
Fetch Next 4-bit Command
01
0
PGD = Input
LSb
MSb
12
34
56
12
3
4
nn
n
P14
(Note 1)
Note
1:
Magnification of the High-Impedance delay between PGC and PGD is shown in Figure 4-5.
(Note 1)
MSb
nn
1
2
P19
PGD
PGC
P3
Yes
No
Start
Blank Check Device
Is
device
blank?
Continue
Abort
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PDF描述 |
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