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参数资料
| 型号： | PIC18LF46K80-I/ML |
| 厂商： | Microchip Technology |
| 文件页数： | 176/351页 |
| 文件大小： | 0K |
| 描述： | MCU PIC ECAN 64KB FLASH 44QFN |
| 产品培训模块： | 8-bit PIC® Microcontroller Portfolio |
| 标准包装： | 45 |
| 系列： | PIC® XLP™ 18F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 64MHz |
| 连通性： | ECAN，I²C，LIN，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，LVD，POR，PWM，WDT |
| 输入/输出数： | 35 |
| 程序存储器容量： | 64KB（32K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 3.6K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 11x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-VQFN 裸露焊盘 |
| 包装： | 管件 |
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2010-2012 Microchip Technology Inc.
DS39977F-page 257
PIC18F66K80 FAMILY
19.2
Capture Mode
In Capture mode, the CCPRxH:CCPRxL register pair
captures the 16-bit value of the Timer register selected
in the CCPTMRS when an event occurs on the CCPx
pin. An event is defined as one of the following:
Every falling edge
Every rising edge
Every 4th rising edge
Every 16th rising edge
The event is selected by the mode select bits,
CCPxM<3:0> (CCPxCON<3:0>). When a capture is
made, the interrupt request flag bit, CCPxIF (PIR4<x>),
is set; it must be cleared in software. If another capture
occurs before the value in CCPRx is read, the old
captured value is overwritten by the new captured
value.
Figure 19-1 shows the Capture mode block diagram.
19.2.1
CCP PIN CONFIGURATION
In Capture mode, the appropriate CCPx pin should be
configured as an input by setting the corresponding
TRIS direction bit.
19.2.2
TIMER1/3 MODE SELECTION
For the available timers (1/3) to be used for the capture
feature, the used timers must be running in Timer mode
or Synchronized Counter mode. In Asynchronous
Counter mode, the capture operation may not work.
The timer to be used with each CCP module is selected
in the CCPTMRS register. (See Section 19.1.1 “CCP
Details of the timer assignments for the CCP modules
are given in Table 19-2.
FIGURE 19-1:
CAPTURE MODE OPERATION BLOCK DIAGRAM
Note:
For CCP2 only, the Capture mode can use
the CCP2 input pin as the capture trigger
for CCP2 or the input can function as a
time-stamp through the CAN module. The
CAN module provides the necessary
control and trigger signals.
CCPR3H
CCPR3L
TMR1H
TMR1L
Set CCP3IF
TMR3
Enable
Q1:Q4
CCP3CON<3:0>
CCP3 Pin
Prescaler
1, 4, 16
and
Edge Detect
TMR1
Enable
C3TSEL
CCPR4H
CCPR4L
TMR1H
TMR1L
Set CCP4IF
TMR3
Enable
CCP4CON<3:0>
CCP4 Pin
Prescaler
1, 4, 16
TMR3H
TMR3L
TMR1
Enable
TMR3H
TMR3L
and
Edge Detect
4
Note:
This block diagram uses CCP3 and CCP4, and their appropriate timers as an example. For details on all of
the CCP modules and their timer assignments, see Table 19-2.
C4TSEL
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