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参数资料
型号： PIC24FV16KA304T-I/MV
厂商： Microchip Technology
文件页数： 61/352页
文件大小： 0K
描述： MCU 16KB FLASH 2KB RAM 48UQFN
标准包装： 3,300
系列： PIC® XLP™ 24F
核心处理器： PIC
芯体尺寸： 16-位
速度： 32MHz
连通性： I²C，IrDA，LIN，SPI，UART/USART
外围设备： 欠压检测/复位，HLVD，POR，PWM，WDT
输入/输出数： 38
程序存储器容量： 16KB（5.5K x 24）
程序存储器类型： 闪存
EEPROM 大小： 512 x 8
RAM 容量： 2K x 8
电压 - 电源 (Vcc/Vdd)： 2 V ~ 5.5 V
数据转换器： A/D 16x12b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 48-UFQFN 裸露焊盘
包装： 带卷 (TR)
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2011-2012 Microchip Technology Inc.
DS39995C-page 153
PIC24FV32KA304 FAMILY
15.2
Compare Operations
In Compare mode (Figure 15-1), the output compare
module can be configured for single-shot or continuous
pulse generation. It can also repeatedly toggle an
output pin on each timer event.
To set up the module for compare operations:
1.
Calculate the required values for the OCxR and
(for Double Compare modes) OCxRS Duty
Cycle registers:
a)
Determine the instruction clock cycle time.
Take into account the frequency of the
external clock to the timer source (if one is
used) and the timer prescaler settings.
b)
Calculate time to the rising edge of the
output pulse relative to the timer start value
(0000h).
c)
Calculate the time to the falling edge of the
pulse, based on the desired pulse width and
the time to the rising edge of the pulse.
2.
Write the rising edge value to OCxR and the
falling edge value to OCxRS.
3.
For Trigger mode operations, set OCTRIG to
enable Trigger mode. Set or clear TRIGMODE
to
configure
the
trigger
operation
and
TRIGSTAT to select a hardware or software
trigger. For Synchronous mode, clear OCTRIG.
4.
Set the SYNCSEL<4:0> bits to configure the
trigger or synchronization source. If free-running
timer operation is required, set the SYNCSELx
bits to ‘00000’ (no Sync/trigger source).
5.
Select
the
time
base
source
with
the
OCTSEL<2:0> bits. If the desired clock source is
running, set the OCTSEL<2:0> bits before the
output compare module is enabled for proper
synchronization with the desired clock source. If
necessary, set the TON bit for the selected timer
which enables the compare time base to count.
Synchronous mode operation starts as soon as
the synchronization source is enabled; Trigger
mode operation starts after a trigger source event
occurs.
6.
Set the OCM<2:0> bits for the appropriate
compare operation (‘0xx’).
For 32-bit cascaded operation, these steps are also
necessary:
1.
Set
the
OC32
bits
for
both
registers
(OCyCON2<8> and (OCxCON2<8>). Enable
the even-numbered module first to ensure the
modules will start functioning in unison.
2.
Clear the OCTRIG bit of the even module
(OCyCON2), so the module will run in
Synchronous mode.
3.
Configure the desired output and Fault settings
for OCy.
4.
Force the output pin for OCx to the output state
by clearing the OCTRIS bit.
5.
If Trigger mode operation is required, configure
the trigger options in OCx by using the OCTRIG
(OCxCON2<7>), TRIGSTAT (OCxCON2<6>)
and SYNCSELx (OCxCON2<4:0>) bits.
6.
Configure the desired Compare or PWM mode
of operation (OCM<2:0>) for OCy first, then for
OCx.
Depending on the output mode selected, the module
holds the OCx pin in its default state and forces a
transition to the opposite state when OCxR matches
the timer. In Double Compare modes, OCx is forced
back to its default state when a match with OCxRS
occurs. The OCxIF interrupt flag is set after an OCxR
match in Single Compare modes and after each
OCxRS match in Double Compare modes.
Single-shot pulse events only occur once, but may be
repeated by simply rewriting the value of the
OCxCON1 register. Continuous pulse events continue
indefinitely until terminated.
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PDF描述
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PIC16LCE623-04/SO IC MCU OTP 512X14 EE 18SOIC
PIC16CE625-04/SS IC MCU OTP 2KX14 EE COMP 20SSOP
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参数描述
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